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參數(shù)資料
| 型號： | SY10EL51ZCTR |
| 廠商： | MICREL INC |
| 元件分類： | 鎖存器 |
| 英文描述： | DIFFERENTIAL CLOCK D FLIP-FLOP |
| 中文描述： | 10EL SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO8 |
| 封裝： | 0.150 INCH, SOIC-8 |
| 文件頁數(shù)： | 1/4頁 |
| 文件大小： | 49K |
| 代理商： | SY10EL51ZCTR |
1
SY10EL51
SY100EL51
Micrel, Inc.
M9999-121205
hbwhelp@micrel.com or (408) 955-1690
DESCRIPTION
s 475ps propagation delay
s 2.8GHz toggle frequency
s Internal 75K
input pull-down resistors
s Available in 8-pin SOIC package
The SY10/100EL51 are differential clock D flip-flops
with reset. These devices are functionally similar to the
E151 devices, with higher performance capabilities. With
propagation delays and output transition times
significantly faster than the E151, the EL51 is ideally
suited for those applications which require the ultimate
in AC performance.
The reset input is an asynchronous, level triggered
signal. Data enters the master portion of the flip-flop
when the clock is LOW and is transferred to the slave,
and thus the outputs, upon a positive transition of the
clock. The differential clock inputs of the EL51 allow the
device to be used as a negative edge triggered flip-flop.
The differential input employs clamp circuitry to
maintain stability under open input (pulled down to VEE)
conditions.
FEATURES
DIFFERENTIAL
CLOCK D FLIP-FLOP
PIN NAMES
Pin
Function
R
Reset Input
D
Data Input
CLK
Clock Input
Q
Data Output
SY10EL51
SY100EL51
D
R
CLK
Q
LL
Z
L
HL
Z
H
XH
X
L
NOTE:
1. Z = LOW-to-HIGH transition.
TRUTH TABLE(1)
1
Rev.: G
Amendment: /0
Issue Date:
December 2005
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SY100EL51ZCTR | DIFFERENTIAL CLOCK D FLIP-FLOP |
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| SY100EL52ZC | DIFFERENTIAL DATA AND CLOCK D FLIP-FLOP |
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| SY10EP53ZI | 5V/3.3V DIFFERENTIAL DATA AND CLOCK D FLIP-FLOP WITH SET AND RESET |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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