參數(shù)資料
型號(hào)： SY10E160
廠商： Micrel Semiconductor,Inc.
英文描述： 12-Bit Parity Generator/Checker(12位奇偶發(fā)生器/校驗(yàn)器)
中文描述： 12位奇偶發(fā)生器/檢查器（12位奇偶發(fā)生器/校驗(yàn)器）
文件頁(yè)數(shù)： 1/4頁(yè)
文件大?。?/td> 60K
代理商： SY10E160
I
Provides odd-HIGH parity of 12 inputs
I
Extended 100E V
EE
range of –4.2V to –5.5V
I
Output register with Shift/Hold capability
I
900ps max. D to Q, /Q output
I
Enable control
I
Asynchronous Register Reset
I
Differential outputs
I
Fully compatible with industry standard 10KH,
100K ECL levels
I
Internal 75K
input pulldown resistors
I
Fully compatible with Motorola MC10E/100E160
I
Available in 28-pin PLCC package
FEATURES
12-BIT PARITY
GENERATOR/CHECKER
The SY10/100E160 are high-speed, 12-bit parity
generator/checkers with differential outputs, for use in
new, high-performance ECL systems. The output Q takes
on a logic HIGH value only when an odd number of inputs
are at a logic HIGH. A logic HIGH on the enable input (EN)
forces the output Q to a logic LOW.
An additional feature of the E160 is the output register.
Two multiplexers and their associated signals control the
register input by providing the option of holding present
data, loading the new parity data or shifting external data
in. To hold the present data, the Hold signal (HOLD) must
be at a logic LOW level. If the HOLD signal is at a logic
HIGH, the data present at the Q output is passed through
the first multiplexer. Taking the Shift signal (SHIFT) to a
logic HIGH will shift the data at the S-IN pin into the output
register. If the SHIFT signal is at a logic LOW, the output
of the first multiplexer is then passed through to the register.
The register itself is clocked on the rising edge of CLK
1
or CLK
2
(or both). The presence of a logic HIGH on the
reset pin (R) forces the register output Y to a logic LOW.
DESCRIPTION
SY10E160
SY100E160
Rev.: D
Issue Date: February, 1998
Amendment: /0
BLOCK DIAGRAM
PIN CONFIGURATION
V
EE
D
8
D
5
D
6
D
7
D
9
D
10
E
26
27
28
1
2
3
4
18
17
16
15
14
13
12
25 24 23 22 21 20 19
5
6
7
8
9
10 11
R
C
2
Q
Q
V
CC
Y
Y
V
CCO
NC
D
1
PLCC
TOP VIEW
J28-1
D
4
D
1
D
2
C
1
S
S
H
D
1
D
3
V
C
Q
Q
MUX
SEL
Y
Y
0
1
MUX
SEL
0
1
R
D
D
0
D
1
D
2
D
3
D
4
D
5
D
6
D
7
D
8
D
9
D
10
D
11
CLK
1
CLK
2
S-IN
SHIFT
R
EN
HOLD
1
相關(guān)PDF資料
PDF描述
SY10E160JCTR CAP,220U,20%,10V,ELECTRO,LOW,ESR
SY10E163JC 2-BIT 8:1 MULTIPLEXER
SY100E163 2-Bit 8:1 Multiplexer(2位8選1多路器)
SY10E163 2-Bit 8:1 Multiplexer(2位8選1多路器)
SY100E163JC 2-BIT 8:1 MULTIPLEXER
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
SY10E160JC 功能描述:IC PARITY GEN/CHKER 12BIT 28PLCC RoHS:否 類別:集成電路 (IC) >> 邏輯 - 奇偶校驗(yàn)發(fā)生器和校驗(yàn)器 系列:10E 產(chǎn)品變化通告:Product Obsolescence 30/Sept/2009 標(biāo)準(zhǔn)包裝:25 系列:10H 邏輯類型:奇偶校驗(yàn)發(fā)生器/校驗(yàn)器 電路數(shù):12 位 輸出電流高，低:- 電源電壓:4.94 V ~ 5.46 V 工作溫度:0°C ~ 75°C 安裝類型:通孔 封裝/外殼:16-DIP（0.300"，7.62mm） 供應(yīng)商設(shè)備封裝:16-DIP
SY10E160JC TR 功能描述:IC PARITY GEN/CHKER 12BIT 28PLCC RoHS:否 類別:集成電路 (IC) >> 邏輯 - 奇偶校驗(yàn)發(fā)生器和校驗(yàn)器 系列:10E 產(chǎn)品變化通告:Product Obsolescence 30/Sept/2009 標(biāo)準(zhǔn)包裝:25 系列:10H 邏輯類型:奇偶校驗(yàn)發(fā)生器/校驗(yàn)器 電路數(shù):12 位 輸出電流高，低:- 電源電壓:4.94 V ~ 5.46 V 工作溫度:0°C ~ 75°C 安裝類型:通孔 封裝/外殼:16-DIP（0.300"，7.62mm） 供應(yīng)商設(shè)備封裝:16-DIP
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SY10E160JZ TR 功能描述:IC PARITY GEN/CHKER 12BIT 28PLCC RoHS:是 類別:集成電路 (IC) >> 邏輯 - 奇偶校驗(yàn)發(fā)生器和校驗(yàn)器 系列:10E 產(chǎn)品變化通告:Product Obsolescence 30/Sept/2009 標(biāo)準(zhǔn)包裝:25 系列:10H 邏輯類型:奇偶校驗(yàn)發(fā)生器/校驗(yàn)器 電路數(shù):12 位 輸出電流高，低:- 電源電壓:4.94 V ~ 5.46 V 工作溫度:0°C ~ 75°C 安裝類型:通孔 封裝/外殼:16-DIP（0.300"，7.62mm） 供應(yīng)商設(shè)備封裝:16-DIP
SY10E163JC 功能描述:IC MULTIPLEXER 2-BIT 8:1 28-PLCC RoHS:否 類別:集成電路 (IC) >> 邏輯 - 信號(hào)開(kāi)關(guān)，多路復(fù)用器，解碼器 系列:10E 標(biāo)準(zhǔn)包裝:25 系列:74HC 類型:解碼器 電路:1 x 2:4 獨(dú)立電路:2 輸出電流高，低:5.2mA，5.2mA 電壓電源:單電源 電源電壓:2 V ~ 6 V 工作溫度:-40°C ~ 85°C 安裝類型:通孔 封裝/外殼:16-DIP（0.300"，7.62mm） 供應(yīng)商設(shè)備封裝:16-DIP 包裝:管件
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