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參數(shù)資料
| 型號： | SY100ELT21LZCTR |
| 廠商： | MICREL INC |
| 元件分類： | 通用總線功能 |
| 英文描述： | 3.3V DIFFERENTIAL LVPECL-to-LVTTL TRANSLATOR |
| 中文描述： | PECL TO TTL TRANSLATOR, TRUE OUTPUT, PDSO8 |
| 封裝： | 0.150 INCH, SOIC-8 |
| 文件頁數(shù)： | 1/4頁 |
| 文件大小： | 51K |
| 代理商： | SY100ELT21LZCTR |
Pin
Function
Q
TTL Output
D, /D
Differential PECL Inputs
V
CC
V
BB
GND
+5.0V Supply
Reference Output
Ground
DESCRIPTION
I
2.5ns typical propagation delay
I
Low power
I
Differential PECL inputs
I
24mA TTL outputs
I
Flow-through pinouts
I
Available in 8-pin SOIC package
The SY10/100ELT21 are single differential PECL-to-
TTL translators. Because PECL (Positive ECL) levels are
used, only +5V and ground are required. The small outline
8-lead SOIC package and low skew single gate design
make the ELT21 ideal for applications that require the
translation of a clock or data signal where minimal space,
low power, and low cost are critical.
The V
BB
output allow differential single-ended, or AC-
coupled interface to the device. If used, the V
BB
output
should be bypassed to V
CC
with a 0.01
μ
F capacitor.
The ELT21 is available in both ECL standards: the
10ELT is compatible with positive ECL 10H logic levels,
while the 100ELT is compatible with positive ECL 100K
logic levels.
FEATURES
DIFFERENTIAL
PECL-to-TTL
TRANSLATOR
PIN NAMES
PIN CONFIGURATION/BLOCK DIAGRAM
SOIC
TOP VIEW
ClockWorks
SY10ELT21
SY100ELT21
1
NC
D
D
V
BB
8
V
CC
Q
NC
GND
7
6
5
2
3
4
PECL
TTL
1
Rev.: B
Issue Date:
Amendment: /0
April 2000
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SY10ELT22LZCTR | 3.3V DUAL TTL-to-DIFFERENTIAL PECL TRANSLATOR |
| SY100ELT22LZCTR | 3.3V DUAL TTL-to-DIFFERENTIAL PECL TRANSLATOR |
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| SY100ELT22ZC | THERMAL UNIT |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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