參數(shù)資料
型號: SH7708S
元件分類: 微控制器/微處理器
英文描述: 32-BIT, RISC MICROCONTROLLER, PQFP144
封裝: PLASTIC, LQFP-144
文件頁數(shù): 47/625頁
文件大?。?/td> 3988K
代理商: SH7708S
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126
5. Sequential use of channels A and B is set in the SEQ bit of the BRCR. When sequential use is
designated, a user break occurs when the channel B conditions are matched after matching of
channel A conditions.
6. When a user break occurs, the CMFA and CMFB bits in the BRCR register are set to 1. If a
break is to be generated again, the CMFA and CMFB bits should be cleared to 0.
7 . 2
UBC Register Functions
7.2.1
Break Address Register A (BARA)
Bit:
31
30
29
28
27
26
25
24
Bit name:
BAA31
BAA30
BAA29
BAA28
BAA27
BAA26
BAA25
BAA24
Initial value:
R/W:
R/W
Bit:
23
22
21
20
19
18
17
16
Bit name:
BAA23
BAA22
BAA21
BAA20
BAA19
BAA18
BAA17
BAA16
Initial value:
R/W:
R/W
Bit:
15
14
13
12
11
10
9
8
Bit name:
BAA15
BAA14
BAA13
BAA12
BAA11
BA10
BAA9
BAA8
Initial value:
R/W:
R/W
Bit:
7
6
5
4
3
2
1
0
Bit name:
BAA7
BAA6
BAA5
BAA4
BAA3
BAA2
BAA1
BAA0
Initial value:
R/W:
R/W
Break address register A (BARA) is a 32-bit read/write register that stores the virtual address of the
channel A break condition. It is not initialized by a reset.
Bits 31 to 0—Break Address A31 to 0 (BAA31 to BAA0): These bits store the virtual address of
the channel A break condition.
7.2.2
Break Address Register B (BARB)
BARB is the break address register for channel B. The bit configuration is the same as for BARA.
相關(guān)PDF資料
PDF描述
SH7708R 32-BIT, RISC MICROCONTROLLER, PQFP144
SI5327D-C-GMR 243 MHz, PROC SPECIFIC CLOCK GENERATOR, QCC36
SI5334B-A00122-GM PLL BASED CLOCK DRIVER, QCC24
SI5334C-A00129-GMR PLL BASED CLOCK DRIVER, QCC24
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參數(shù)描述
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