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參數(shù)資料
| 型號(hào)： | SAFC165H |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | EMBEDDED C166 WITH USART IOM-2 AND HDLC SUPPORT |
| 中文描述： | 嵌入式的C166與國(guó)際移民組織的USART - 2和HDLC支持 |
| 文件頁(yè)數(shù)： | 34/499頁(yè) |
| 文件大?。?/td> | 6140K |
| 代理商： | SAFC165H |
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C165H
Architectural Overview
Data Sheet
34
2001-04-19
PRELMNARY
The PEC contains a set of SFRs which store the count value and control bits for eight
data transfer channels. In addition, the PEC uses a dedicated area of RAM which
contains the source and destination addresses. The PEC is controlled similar to any
other peripheral through SFRs containing the desired configuration of each channel.
An individual PEC transfer counter is implicitly decremented for each PEC service
except forming in the continuous transfer mode. When this counter reaches zero, a
standard interrupt is performed to the vector location related to the corresponding
source. PEC services are very well suited, for example, to move register contents to/from
-EXCERPT-
With an interrupt response time within a range from just 140 ns to 280 ns (in case of
internal program execution), the C165H is capable of reacting very fast on non-
deterministic events.
Its fast external interrupt inputs are sampled every 28 ns and allow to recognize even
very short external signals.
or error conditions that arise during run-time, so called 'Hardware Traps'. Hardware traps
cause an immediate non-maskable system reaction which is similiar to a standard
interrupt service (branching to a dedicated vector table location). The occurrence of a
hardware trap is additionally signified by an individual bit in the trap flag register (TFR).
Except for another higher prioritized trap service being in progress, a hardware trap will
interrupt any current program execution. In turn, hardware trap services can normally not
be interrupted by standard or PEC interrupts.
Software interrupts are supported by means of the 'TRAP' instruction in combination with
an individual trap (interrupt) number.
3.2
On-Chip System Resources
C165H controllers provide a number of powerful system resources designed around the
CPU. The combination of CPU and these resources results in the high performance of
the members of this controller family.
Peripheral Event Controller (PEC) and Interrupt Control
The Peripheral Event Controller allows to respond to an interrupt request with a single
data transfer (word or byte) which only consumes one instruction cycle and does not
require to save and restore the machine status. Each interrupt source is prioritized every
machine cycle in the interrupt control block. If PEC service is selected, a PEC transfer is
started. If CPU interrupt service is requested, the current CPU priority level stored in the
PSW register is tested to determine whether a higher priority interrupt is currently being
serviced. When an interrupt is acknowledged, the current state of the machine is saved
on the internal system stack and the CPU branches to the system specific vector for the
peripheral.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SAFC165UTAH | EMBEDDED C166 WITH USART IOM-2 AND HDLC SUPPORT |
| SAFC503 | 8-Bit CMOS Microcontroller |
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參數(shù)描述 |
|---|---|
| SAF-C165H-LF V1.3 | 功能描述:16位微控制器 - MCU IC COMM CTRLR RISC ROMLESS 36MHZ 3.3V RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數(shù)據(jù)總線寬度:16 bit 最大時(shí)鐘頻率:24 MHz 程序存儲(chǔ)器大小:8 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風(fēng)格:SMD/SMT |
| SAFC165H-LF V1.3TR | 制造商:Lantiq 功能描述: |
| SAFC165HLFV1.3 | 制造商:Lantiq 功能描述: 制造商:Rochester Electronics LLC 功能描述: 制造商:Infineon Technologies AG 功能描述: |
| SAF-C165HLFV1.3 | 制造商:Lantiq 功能描述: |
| SAF-C165H-LFV1.3 | 制造商:Infineon Technologies AG 功能描述: |
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