參數(shù)資料
型號： SAF82532
廠商： SIEMENS AG
英文描述： ICs for Communications
中文描述： 通信集成電路
文件頁數(shù)： 134/272頁
文件大小： 4055K
代理商： SAF82532
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SAB 82532/SAF 82532
Detailed Register Description
Semiconductor Group
134
07.96
Channel Configuration Register 0 (CCR0)
Access: read/write
address: ch-A: 2C
H
ch-B: 6C
H
Value after RESET: 00
H
Note: Unused bits have to be set to logical ‘0'.
7
0
CCR0
PU
MCE
0
SC2
SC1
SC0
SM1
SM0
PU …
Switches between power-up and power-down mode
0 … power-down (standby)
1 … power-up (active)
Master Clock Enable
If this bit is set to ‘1’, the clock provided via pin XTAL1 works as
master clock to allow full functionality of the microprocessor
interface (access to all status and control registers and FIFOs,
DMA and interrupt support) independent of the receive and the
transmit clocks. The internal oscillator in conjunction with a crystal
on XTAL1-2 can be used, too. The master clock option is not
applicable in clock mode 5 or in SDLC Loop mode. Refer to table
5 for more details.
Note: The internal timers run with the master clock.
Serial Port Configuration
000 … NRZ data encoding
001 … bus configuration, timing mode 1
010 … NRZI data encoding
011 … bus configuration, timing mode 2
100 … FM0 data encoding
101 … FM1 data encoding
110 … MANCHESTER data encoding
111 … (not used)
Note: If bus configuration is selected, only NRZ coding is
supported.
Serial Mode
00 … HDLC/SDLC mode
01 … SDLC Loop mode
10 … BISYNC mode
11 … ASYNC mode
MCE …
SC2 … SC0 …
SM1
…
SM0
…
HDLC Mode
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PDF描述
SAF82532N-10 ICs for Communications
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SAB-C163-LF 16-bit CMOS Single-Chip Microcontroller
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