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參數(shù)資料
| 型號： | SAB82525N |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | Data Communications ICs |
| 中文描述： | 數(shù)據(jù)通信集成電路 |
| 文件頁數(shù)： | 59/126頁 |
| 文件大?。?/td> | 730K |
| 代理商： | SAB82525N |
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Semiconductor Group
59
SAB 82525
SAB 82526
SAF 82525
SAF 82526
– Phase Shift
In the case the DPLL detects an edge in the data stream in the range of DPLL count 5 to 10
(Phase Shift) and this is the only one in the assumed bit cell period, then the DPLL receive
clock phase is shifted by a certain DPLL count value.
Figure 28d
Synchronization of the Data Clock in DPLL Mode: Interference Rejection and Phase
Adjustment
The DPLL value and its corresponding phase shift in degree is listed below for the HSCX
versions VA3 and V2.1:
Note:
The operating characteristics of the DPLL therefore allow a phase jitter of 18.75% of the
frequency.
HSCX Version
DPLL Count
Phase Shift
VA3
8
180
o
V2.1
7
157,5
o
ITD05884
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
Phase Adjust
Phase Shift
+
-
Assumed Bit Cell
DPLL Input
Receive Data
DPLL Count
DPLL
Phase Correction
DPLL Output
Receive Clock
+
+
1
7
1
-
Phase Adjust
Phase Shift
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SAB82526 | Data Communications ICs |
| SAB82526N | Data Communications ICs |
| SAF82525N | Data Communications ICs |
| SAF82526 | Data Communications ICs |
| SAF82526N | Data Communications ICs |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SAB82525N-V2.1 | 制造商:Siemens 功能描述:82525N-V2.1 |
| SAB82525NV2.1GHSCX | 制造商:Infineon Technologies AG 功能描述: |
| SAB82525N-V2.1GHSCX | 制造商:Infineon Technologies AG 功能描述: |
| SAB82525NV2.1HSCX | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| SAB82525NV2.2 | 功能描述:輸入/輸出控制器接口集成電路 T/E RoHS:否 制造商:Silicon Labs 產(chǎn)品: 輸入/輸出端數(shù)量: 工作電源電壓: 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-64 封裝:Tray |
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