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參數(shù)資料
| 型號(hào)： | SAA7326 |
| 廠商： | NXP Semiconductors N.V. |
| 英文描述： | Digital servo processor and Compact Disc decoder with integrated DAC (CD10 II)(具有綜合數(shù)模轉(zhuǎn)換器（DAC）的數(shù)字伺服處理器和光盤譯碼器) |
| 中文描述： | 數(shù)字伺服處理器和光盤解碼器集成了援會(huì)（CD10型二）（具有綜合數(shù)模轉(zhuǎn)換器（DAC）的的數(shù)字伺服處理器和光盤譯碼器） |
| 文件頁(yè)數(shù)： | 43/68頁(yè) |
| 文件大?。?/td> | 284K |
| 代理商： | SAA7326 |
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2000 Jun 26
43
Philips Semiconductors
Product specification
Digital servo processor and Compact Disc
decoder with integrated DAC (CD10 II)
SAA7326
Table 15
Loop filter bandwidth
Note
1.
The initial column shows the power-on reset state.
7.15.5
S
UMMARY OF FUNCTIONS CONTROLLED BY SHADOW REGISTERS
Table 16
Shadow register settings
REGISTER
ADDRESS
DATA
FUNCTION
INITIAL
(1)
LOOP
BANDWIDTH
(Hz)
1640
×
n
3279
×
n
6560
×
n
1640
×
n
3279
×
n
6560
×
n
1640
×
n
3279
×
n
6560
×
n
1640
×
n
3279
×
n
6560
×
n
INTERNAL
BANDWIDTH
(Hz)
525
×
n
263
×
n
131
×
n
1050
×
n
525
×
n
263
×
n
2101
×
n
1050
×
n
525
×
n
4200
×
n
2101
×
n
1050
×
n
LOW-PASS
BANDWIDTH
(Hz)
8400
×
n
16800
×
n
33600
×
n
8400
×
n
16800
×
n
33600
×
n
8400
×
n
16800
×
n
33600
×
n
8400
×
n
16800
×
n
33600
×
n
8
(PLL loop filter
bandwidth)
1000
0000
0001
0010
0100
0101
0110
1000
1001
1010
1100
1101
1110
reset
SHADEN BIT
SHADOW
REGISTER
ADDRESS
DATA
FUNCTION
INITIAL
1
3
control of
versatile and
clock pins
0011
XXX0
XXX1
XX0X
XX1X
select CL4 on CL11/4 output
select CL11 on CL11/4 output
enable CL11/4 output pin
set CL11/4 output pin to
high-impedance
enable CL16 output pin
set CL16 output pin to
high-impedance
V2/V3 pin configured as V2 input
V2/V3 pin configured as V3 output
(open-drain)
reset
reset
X0XX
X1XX
reset
0XXX
1XXX
reset
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