參數(shù)資料
型號： S912XDG256J1MAL
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP112
封裝： LEAD FREE, LQFP-112
文件頁數(shù)： 626/1000頁
文件大?。?/td> 3287K
代理商： S912XDG256J1MAL
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Chapter 15 Serial Peripheral Interface (S12SPIV4)
MC9S12XDP512 Data Sheet, Rev. 2.13
Freescale Semiconductor
661
15.3.2.2
SPI Control Register 2 (SPICR2)
Read: Anytime
Write: Anytime; writes to the reserved bits have no effect
Table 15-2. SS Input / Output Selection
MODFEN
SSOE
Master Mode
Slave Mode
00
SS not used by SPI
SS input
01
SS not used by SPI
SS input
10
SS input with MODF feature
SS input
11
SS is slave select output
SS input
76543210
R
000
MODFEN
BIDIROE
0
SPISWAI
SPC0
W
Reset
00000000
= Unimplemented or Reserved
Figure 15-4. SPI Control Register 2 (SPICR2)
Table 15-3. SPICR2 Field Descriptions
Field
Description
4
MODFEN
Mode Fault Enable Bit — This bit allows the MODF failure to be detected. If the SPI is in master mode and
MODFEN is cleared, then the SS port pin is not used by the SPI. In slave mode, the SS is available only as an
input regardless of the value of MODFEN. For an overview on the impact of the MODFEN bit on the SS port pin
conguration, refer to Table 15-4. In master mode, a change of this bit will abort a transmission in progress and
force the SPI system into idle state.
0 SS port pin is not used by the SPI.
1 SS port pin with MODF feature.
3
BIDIROE
Output Enable in the Bidirectional Mode of Operation — This bit controls the MOSI and MISO output buffer
of the SPI, when in bidirectional mode of operation (SPC0 is set). In master mode, this bit controls the output
buffer of the MOSI port, in slave mode it controls the output buffer of the MISO port. In master mode, with SPC0
set, a change of this bit will abort a transmission in progress and force the SPI into idle state.
0 Output buffer disabled.
1 Output buffer enabled.
1
SPISWAI
SPI Stop in Wait Mode Bit — This bit is used for power conservation while in wait mode.
0 SPI clock operates normally in wait mode.
1 Stop SPI clock generation when in wait mode.
0
SPC0
Serial Pin Control Bit 0 — This bit enables bidirectional pin congurations as shown in Table 15-4. In master
mode, a change of this bit will abort a transmission in progress and force the SPI system into idle state.
相關PDF資料
PDF描述
S912XDT512J1VAG 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP144
S912XD256J1CAL 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP112
S912XDT384J1MAA 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP80
S912XDT512J1CAG 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP144
S912XD256J1CAGR 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP144
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參數(shù)描述
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S912XDG256J1VAGR 制造商:Freescale Semiconductor 功能描述:BLUEFIN AUTO - Tape and Reel
S912XDG384J1CAL 制造商:Freescale Semiconductor 功能描述:BLUEFIN AUTO - Bulk
S912XDG384J1CALR 制造商:Freescale Semiconductor 功能描述:BLUEFIN AUTO - Tape and Reel
S912XDG512J1CAG 制造商:Freescale Semiconductor 功能描述:MCU 16BIT HCS12 RISC 512KB FLASH 2.5V/5V 144LQFP - Bulk
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