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參數(shù)資料
| 型號(hào)： | PT7C4302WEX |
| 廠商： | Pericom |
| 文件頁數(shù)： | 8/13頁 |
| 文件大小： | 0K |
| 描述： | IC RTC NVSRAM 8SOIC |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 類型： | 時(shí)鐘/日歷 |
| 特點(diǎn)： | 閏年，NVSRAM，方波輸出，涓流充電器 |
| 存儲(chǔ)容量： | 31B |
| 時(shí)間格式： | HH:MM:SS（12/24 小時(shí)） |
| 數(shù)據(jù)格式： | YY-MM-DD-dd |
| 接口： | 3 線串口 |
| 電源電壓： | 1.2 V ~ 5.5 V |
| 電壓 - 電源，電池： | 1.5 V ~ 5.5 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 8-SOIC（0.154"，3.90mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 8-SOIC |
| 包裝： | 標(biāo)準(zhǔn)包裝 |
| 其它名稱： | PT7C4302WEXDKR |
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12-07-0001
PT0225-4
07/04/12
4
PT7C4302
Real-time Clock Module (3-wire Interface)
AC Electrical Characteristics
Figure 6 a Timing diagram: Read data transfer
Figure 6 b Timing diagram: Write data transfer
TA = -40 °C to +85 °C. Unless otherwise specified.
Parameter
Sym
Min
Typ
Max
Unit
Notes
Data to CLK Setup
tDC
VCC=2.0V
200
-
ns
1
VCC=5.0V
50
-
CLK to Data Hold
tCDH
VCC=2.0V
280
-
ns
1
VCC=5.0V
70
-
CLK to Data Delay
tCDD
VCC=2.0V
-
800
ns
1,2,3
VCC=5.0V
-
200
CLK Low Time
tCL
VCC=2.0V
1000
-
ns
1
VCC=5.0V
250
-
CLK High Time
tCH
VCC=2.0V
1000
-
ns
1
VCC=5.0V
250
-
CLK Frequency
tCLK
VCC=2.0V
-
0.5
MHz
1
VCC=5.0V
0
-
2.0
CLK Rise and Fall
tR ,tF
VCC=2.0V
-
2000
ns
1
VCC=5.0V
-
500
RST to CLK Setup
tCC
VCC=2.0V
4
-
s
1
VCC=5.0V
1
-
CLK to RST Hold
tCCH
VCC=2.0V
240
-
ns
1
VCC=5.0V
60
-
RST Inactive Time
tCWH
VCC=2.0V
4
-
s
1
VCC=5.0V
1
-
RST to I/O High-Z
tCDZ
VCC=2.0V
-
280
ns
1
VCC=5.0V
-
70
SCLK to I/O High-Z
tCCZ
VCC=2.0V
-
280
ns
1
VCC=5.0V
-
70
Note:
1. Measured at VIH = 2.0V or VIL = 0.8V and 10ns maximum rise and fall time.
2. Measured at VOH = 2.4V or VOL = 0.4V.
3. Load capacitance = 50pF.
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PDF描述 |
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