參數(shù)資料
型號： PIC18F65K90-I/MR
廠商： Microchip Technology
文件頁數(shù)： 149/338頁
文件大小： 0K
描述： IC MCU 8BIT 32KB FLASH 64QFN
產(chǎn)品培訓(xùn)模塊： 8-bit PIC® Microcontroller Portfolio
標準包裝： 40
系列： PIC® XLP™ 18F
核心處理器： PIC
芯體尺寸： 8-位
速度： 64MHz
連通性： I²C，LIN，SPI，UART/USART
外圍設(shè)備： 欠壓檢測/復(fù)位，LCD，POR，PWM，WDT
輸入/輸出數(shù)： 53
程序存儲器容量： 32KB（16K x 16）
程序存儲器類型： 閃存
EEPROM 大小： 1K x 8
RAM 容量： 2K x 8
電壓 - 電源 (Vcc/Vdd)： 1.8 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 16x12b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 64-VFQFN 裸露焊盤
包裝： 管件
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PIC18F87K90 FAMILY
DS39957D-page 232
2009-2011 Microchip Technology Inc.
TABLE 17-4:
ALRMVAL REGISTER
MAPPING
17.2.9
CALIBRATION
The real-time crystal input can be calibrated using the
periodic auto-adjust feature. When properly calibrated,
the RTCC can provide an error of less than three
seconds per month.
To perform this calibration, find the number of error
clock pulses and store the value into the lower half of
the RTCCAL register. The 8-bit, signed value, loaded
into RTCCAL, is multiplied by four and will be either
added or subtracted from the RTCC timer, once every
minute.
To calibrate the RTCC module:
1.
Use another timer resource on the device to find
the error of the 32.768 kHz crystal.
2.
Convert the number of error clock pulses per
minute (see Equation 17-1).
If the oscillator is faster than ideal (negative
result from Step 2), the RCFGCALL register
value needs to be negative. This causes the
specified number of clock pulses to be
subtracted from the timer counter, once every
minute.
If the oscillator is slower than ideal (positive
result from Step 2), the RCFGCALL register
value needs to be positive. This causes the
specified number of clock pulses to be added to
the timer counter, once every minute.
3.
Load the RTCCAL register with the correct
value.
Writes to the RTCCAL register should occur only when
the timer is turned off or immediately after the rising
edge of the seconds pulse.
17.3
Alarm
The Alarm features and characteristics are:
Configurable from half a second to one year
Enabled using the ALRMEN bit (ALRMCFG<7>,
Offers one-time and repeat alarm options
17.3.1
CONFIGURING THE ALARM
The alarm feature is enabled using the ALRMEN bit.
This bit is cleared when an alarm is issued. The bit will
not be cleared if the CHIME bit = 1 or if ALRMRPT
0.
The interval selection of the alarm is configured
through the ALRMCFG bits (AMASK<3:0>) (see
Figure 17-5). These bits determine which, and how
many, digits of the alarm must match the clock value for
the alarm to occur.
The alarm can also be configured to repeat based on a
preconfigured interval. The number of times this
occurs, after the alarm is enabled, is stored in the
ALRMRPT register.
ALRMPTR<1:0>
Alarm Value Register Window
ALRMVALH
ALRMVALL
00
ALRMMIN
ALRMSEC
01
ALRMWD
ALRMHR
10
ALRMMNTH
ALRMDAY
11
——
EQUATION 17-1:
CONVERTING ERROR
CLOCK PULSES
(Ideal Frequency (32,758) – Measured Frequency) * 60 =
Error Clocks per Minute
Note:
In determining the crystal’s error value, it
is the user’s responsibility to include the
crystal’s initial error from drift due to
temperature or crystal aging.
Note:
While the alarm is enabled (ALRMEN = 1),
changing any of the registers, other than
the RTCCAL, ALRMCFG and ALRMRPT
registers and the CHIME bit, can result in a
false alarm event leading to a false alarm
interrupt. To avoid this, only change the
timer and alarm values while the alarm is
disabled (ALRMEN = 0). It is recommended
that the ALRMCFG and ALRMRPT regis-
ters and CHIME bit be changed when
RTCSYNC = 0.
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