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參數(shù)資料
| 型號： | PIC16C73BT-20E/SS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, OTPROM, 20 MHz, RISC MICROCONTROLLER, PDSO28 |
| 封裝： | 0.209 INCH, PLASTIC, MS-150, SSOP-28 |
| 文件頁數(shù)： | 153/184頁 |
| 文件大?。?/td> | 2181K |
| 代理商： | PIC16C73BT-20E/SS |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁當(dāng)前第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁
PIC16C63A/65B/73B/74B
DS30605C-page 70
2000 Microchip Technology Inc.
11.2.2
USART ASYNCHRONOUS
RECEIVER
The receiver block diagram is shown in Figure 11-4.
The data is received on the RC7/RX/DT pin and drives
the data recovery block. The data recovery block is
actually a high speed shifter operating at x16 times the
baud rate, whereas the main receive serial shifter oper-
ates at the bit rate or at FOSC.
Once Asynchronous mode is selected, reception is
enabled by setting bit CREN (RCSTA<4>).
The heart of the receiver is the receive (serial) shift reg-
ister (RSR). After sampling the STOP bit, the received
data in the RSR is transferred to the RCREG register (if
it is empty). If the transfer is complete, USART Receive
Flag bit RCIF (PIR1<5>) is set. This interrupt can be
enabled/disabled
by
setting/clearing
the
USART
Receive Enable bit RCIE (PIE1<5>).
Flag bit RCIF is a read only bit, which is cleared by the
hardware. It is cleared when the RCREG register has
been read and is empty. The RCREG is a double buff-
ered register, i.e., it is a two-deep FIFO. It is possible
for two bytes of data to be received and transferred to
the RCREG FIFO and a third byte to begin shifting to
the RSR register. On the detection of the STOP bit of
the third byte, if the RCREG register is still full, then
overrun error bit OERR (RCSTA<1>) will be set. The
word in the RSR will be lost. The RCREG register can
be read twice to retrieve the two bytes in the FIFO.
Overrun bit OERR has to be cleared in software. This
is done by resetting the receive logic (CREN is cleared
and then set). If bit OERR is set, transfers from the
RSR register to the RCREG register are inhibited, and
no further data will be received; therefore, it is essential
to clear error bit OERR if it is set. Framing error bit
FERR (RCSTA<2>) is set if a STOP bit is detected as
clear. Bit FERR and the 9th receive bit are buffered the
same way as the receive data. Reading the RCREG
will load bits RX9D and FERR with new values, there-
fore, it is essential for the user to read the RCSTA reg-
ister before reading the RCREG register, in order not to
lose the old FERR and RX9D information.
FIGURE 11-4:
USART RECEIVE BLOCK DIAGRAM
x64 Baud Rate CLK
SPBRG
Baud Rate Generator
RC7/RX/DT
Pin Buffer
and Control
SPEN
Data
Recovery
CREN
OERR
FERR
RSR Register
MSb
LSb
RX9D
RCREG Register
FIFO
Interrupt
RCIF
RCIE
Data Bus
8
÷ 64
÷ 16
or
STOP
START
(8)
7
1
0
RX9
FOSC
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PIC16C74B-04I/P | 8-BIT, OTPROM, 4 MHz, RISC MICROCONTROLLER, PDIP40 |
| PIC16LC73B-04I/SS | 8-BIT, OTPROM, 4 MHz, RISC MICROCONTROLLER, PDSO28 |
| PIC16LC74B-04I/P | 8-BIT, OTPROM, 4 MHz, RISC MICROCONTROLLER, PDIP40 |
| PIC16C72-4E/SO | 8-BIT, OTPROM, 4 MHz, RISC MICROCONTROLLER, PDSO28 |
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參數(shù)描述 |
|---|---|
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| PIC16C74-04/L | 制造商:Microchip Technology Inc 功能描述: |
| PIC16C74-04/P | 制造商:Microchip Technology Inc 功能描述: 制造商:Microchip Technology Inc 功能描述:MicroController, 8-Bit, 40 Pin, Plastic, DIP |
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