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參數(shù)資料
| 型號： | PD78F0134M1GB(A1)-8EU |
| 廠商： | NEC Corp. |
| 元件分類： | 8位微控制器 |
| 英文描述： | 8-Bit Single-Chip Microcontrollers |
| 中文描述： | 8位單芯片微控制器 |
| 文件頁數(shù)： | 557/558頁 |
| 文件大?。?/td> | 4436K |
| 代理商： | PD78F0134M1GB(A1)-8EU |
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APPENDIX D REVISION HISTORY
User’s Manual U16228EJ2V0UD
557
(2/3)
Page
Description
p. 133
Modification of
Notes 4
and
5
in
Figure 5-13 Status Transition Diagram (2)
p. 135
Modification of
Note 4
and illustration in
Figure 5-13 Status Transition Diagram (4)
p. 136
Modification of
Table 5-3 Relationship Between Operation Clocks in Each Operation Status
p. 139
Modification of
Note
in
Figure 5-14 Switching from Ring-OSC Clock to X1 Input Clock (Flowchart)
p. 141
Addition of
Note
to
Figure 5-16 Switching from X1 Input Clock to Subsystem Clock (Flowchart)
p. 144
Revision of
CHAPTER 6 16-BIT TIMER/EVENT COUNTERS 00 AND 01
p. 187
Revision of
CHAPTER 7 8-BIT TIMER/EVENT COUNTERS 50 AND 51
p. 205
Revision of
CHAPTER 8 8-BIT TIMERS H0 AND H1
p. 230
Modification of
Figure 9-1 Block Diagram of Watch Timer
p. 236
Addition of
Figure 9-4 Example of Generation of Watch Timer Interrupt Request (INTWT) (When
Interrupt Period = 0.5 s)
p. 247
Modification of
Figure 11-1 Block Diagram of Clock Output/Buzzer Output Controller
p. 251
Revision of
CHAPTER 12 A/D CONVERTER
p. 272
Revision of
CHAPTER 13 SERIAL INTERFACE UART0
p. 293
Revision of
CHAPTER 14 SERIAL INTERFACE UART6
p. 331
Revision of
CHAPTER 15 SERIAL INTERFACES CSI10 AND CSI11
p. 351
Revision of
CHAPTER 16 MULTIPLIER/DIVIDER
pp. 361, 362
Addition of
Note
to INTVLI, POC, and LVI in
Table 17-1 Interrupt Source List
p. 365
Addition of
Note 2
to
Table 17-2 Flags Corresponding to Interrupt Request Sources
p. 366
Addition of
Caution 2
to
Figure 17-2 Format of Interrupt Request Flag Registers (IF0L, IF0H, IF1L, IF1H)
p. 369
Addition of
Caution
to
Table 17-3 Ports Corresponding to EGPn and EGNn
p. 374
Addition of software interrupt request item to
Table 17-5 Relationship Between Interrupt Requests
Enabled for Multiple Interrupt Servicing During Interrupt Servicing
p. 378
Modification of
Figure 18-1 Block Diagram of Key Interrupt
p. 380
Modification of
Table 19-1 Relationship Between HALT Mode, STOP Mode, and Clock
in old edition to
Table 19-1 Relationship Between Operation Clocks in Each Operation Status
p. 384
Addition of
Cautions 2
and
3
to
Figure 19-1 Format of Oscillation Stabilization Time Counter Status
Register (OSTC)
p. 385
Modification of
Table 19-2 Operating Statuses in HALT Mode
p. 388
Addition of
(3) When subsystem clock is used as CPU clock
to
Figure 19-4 HALT Mode Release by
RESET Input
p. 389
Modification of the following items in
Table 19-4 Operating Statuses in STOP Mode
8-bit timer H0
Serial interfaces UART0 and UART6
pp. 394 to 396
Modification of
Figure 20-1 Block Diagram of Reset Function
to
Figure 20-4 Timing of Reset in STOP
Mode by RESET Input
p. 401
Modification of
Figure 21-1 Block Diagram of Clock Monitor
p. 403
Addition of normal operation mode to
Table 21-2 Operation Status of Clock Monitor (When CLME = 1)
pp. 406, 407
Addition of
(6) Clock monitor status after X1 input clock oscillation is stopped by software
and
(7)
Clock monitor status after Ring-OSC clock oscillation is stopped by software
to
Figure 21-3 Timing of
Clock Monitor
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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