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參數(shù)資料
| 型號： | PCKV857EV,118 |
| 廠商： | NXP Semiconductors |
| 文件頁數(shù)： | 10/15頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC 1:10 2.5V PLL CLK-DRVR48TSSOP |
| 標準包裝： | 3,500 |
| 類型： | 時鐘緩沖器/驅(qū)動器，多路復(fù)用器 |
| PLL： | 是 |
| 主要目的： | 存儲器，DDR，SDRAM |
| 輸入： | SSTL-2 |
| 輸出： | SSTL-2 |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:10 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 190MHz |
| 電源電壓： | 2.3 V ~ 2.7 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 56-VFBGA |
| 供應(yīng)商設(shè)備封裝： | 56-VFBGA（4.5x7） |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 935272338118 PCKV857EV-T PCKV857EV-T-ND |
Philips Semiconductors
Product data
PCKV857
70–190 MHz differential 1:10 clock driver
2002 Sep 13
4
FUNCTION TABLE
INPUTS
OUTPUTS
PLL ON/OFF
PWRDWN
CLK
Yn
FBOUT
PLL ON/OFF
L
H
Z
Z1
OFF
L
H
L
Z
Z1
OFF
H
L
H
L
H
L
H
ON
H
L
H
L
H
L
ON
X2
< 20 MHz
Z
Z1
OFF
NOTES:
H = HIGH voltage level
L = LOW voltage level
Z = high impedance OFF-state
X = don’t care
1. Subject to change. May cause conflict with FBIN pins.
2. Additional feature that senses when the clock input is less than 20 MHz and places the part in sleep mode.
BLOCK DIAGRAM
PLL
37 – PWRDWN
13 – CLK
14 – CLK
36 – FBIN
35 – FBIN
16 – AVDD
3 – Y0
2 – Y0
5 – Y1
6 – Y1
10 – Y2
9 – Y2
20 – Y3
19 – Y3
22 – Y4
23 – Y4
46 – Y5
47 – Y5
44 – Y6
43 – Y6
39 – Y7
40 – Y7
29 – Y8
30 – Y8
27 – Y9
28 – Y9
32 – FBOUT
33 – FBOUT
SW00692
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| PCKW-124D2M,000 | 功能描述:通用繼電器 SPST-NO DUAL CL 24DC RoHS:否 制造商:Omron Electronics 觸點形式:1 Form A (SPST-NO) 觸點電流額定值:150 A 線圈電壓:24 VDC 線圈電阻:144 Ohms 線圈電流:167 mA 切換電壓:400 V 安裝風(fēng)格:Chassis 觸點材料: |
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