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參數(shù)資料
| 型號： | P83C180 |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Microcontrollers for monitors with DDC interface, auto-sync detection and sync proc(帶DDC接口，同步監(jiān)測和同步處理的監(jiān)視器微控制器) |
| 中文描述： | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, PDIP42 |
| 封裝： | 0.600 INCH, PLASTIC, SOT-270-1, SDIP-42 |
| 文件頁數(shù)： | 73/84頁 |
| 文件大小： | 420K |
| 代理商： | P83C180 |
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1997 Dec 12
73
Philips Semiconductors
Product specification
Microcontrollers for monitors with DDC
interface, auto-sync detection and sync proc.
P83Cx80; P87C380
27 AC CHARACTERISTICS
V
DD
= 4.5 V to 5.5 V; V
SS
= 0 V; T
amb
=
25 to + 85
°
C; all voltages with respect to V
SS
unless otherwise specified.
SYMBOL
PARAMETER
CONDITIONS
MIN.
TYP.
MAX.
UNIT
f
clk
f
PXE
C
XTAL1
crystal oscillator frequency
PXE resonator frequency
external capacitance at XTAL1
with crystal resonator
with PXE resonator
external capacitance at XTAL2
with crystal resonator
with PXE resonator
V
DD
= 5 V
V
DD
= 5 V
10
10
12
12
16
16
MHz
MHz
20
20
27
27
pF
pF
C
XTAL2
20
20
27
27
pF
pF
Analog-to-Digital Converter (software)
V
in(A)
comparator analog input voltages
ADC0; ADC1
conversion error range
conversion time (from any change in
ADC input i.e. voltage level)
V
SS
V
DD
V
V
AE
t
conv(ADC)
±
1
2
7
LSB
μ
s
DDC1 Mode
(1)
(transmit-only, unidirectional); see Figs
25
and
35
t
DOV
t
VCLKH
t
VCLKL
t
t(mode)
t
sup(input)
output valid from VCLK
VCLK high time
VCLK low time
mode transition time
input filter spike suppression; for SDA,
SCL and VSYNC
DDC1 mode set-up time
20
20
30
800
200
μ
s
μ
s
μ
s
ns
ns
t
su(DDC1)
5
μ
s
Horizontal sync input for the mode detection;
see Fig.36
Hfreq
t
W(HSYNC)
H
DCYC
t
ir(HSYNC)
t
if(HSYNC)
HSYNC input frequency
HSYNC input pulse width
HSYNC input duty cycle
HSYNC input rise time
HSYNC input fall time
15
0.25
150
8
25
100
100
kHz
μ
s
%
ns
ns
notes 2 and 3
notes 2 and 3
Vertical Sync Input for the Mode Detection; see
Fig.37
Vfreq
t
W(VSYNC)
V
DCYC
t
ir(VSYNC)
t
if(VSYNC)
VSYNC input frequency
VSYNC input pulse width
VSYNC input duty cycle
VSYNC input rise time
VSYNC input fall time
40
1
200
24
25
100
100
Hz
note 5
%
ns
ns
note 4
note 4
相關PDF資料 |
PDF描述 |
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