參數(shù)資料
型號(hào)： P312XDP512F0MPVR
廠商： 飛思卡爾半導(dǎo)體(中國)有限公司
英文描述： Covers, S12XD, S12XB & S12XA Families
中文描述： 封面，S12XD，S12XB
文件頁數(shù)： 746/1350頁
文件大?。?/td> 3951K
代理商： P312XDP512F0MPVR
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Chapter 20 S12X Debug (S12XDBGV3) Module
MC9S12XDP512 Data Sheet, Rev. 2.17
746
Freescale Semiconductor
The trace buffer is visible through a 2-byte window in the register address map and can be read out using
standard 16-bit word reads. Tracing is disabled when the MCU system is secured.
20.1.3
Features
Four comparators (A, B, C, and D)
— Comparators A and C compare the full address bus and full 16-bit data bus
— Comparators A and C feature a data bus mask register
— Comparators B and D compare the full address bus only
— Each comparator can be configured to monitor either S12XCPU or XGATE buses
— Each comparator features control of R/W and byte/word access cycles
— Comparisons can be used as triggers for the state sequencer
Three comparator modes
— Simple address/data comparator match mode
— Inside address range mode, Addmin
≤
Address
≤
Addmax
— Outside address range match mode, Address
<
Addmin or Address
>
Addmax
Two types of triggers
— Tagged — This triggers just before a specific instruction begins execution
— Force — This triggers on the first instruction boundary after a match occurs.
Three types of breakpoints
— S12XCPU breakpoint entering BDM on breakpoint (BDM)
— S12XCPU breakpoint executing SWI on breakpoint (SWI)
— XGATE breakpoint
Three trigger modes independent of comparators
— External instruction tagging (associated with S12XCPU instructions only)
— XGATE S/W breakpoint request
— TRIG Immediate software trigger
Four trace modes
— Normal: change of flow (COF) PC information is stored (see
Section 20.4.5.2.1
) for change of
flow definition.
— Loop1: same as Normal but inhibits consecutive duplicate source address entries
— Detail: address and data for all cycles except free cycles and opcode fetches are stored
— Pure PC: All program counter addresses are stored.
4-stage state sequencer for trace buffer control
— Tracing session trigger linked to Final State of state sequencer
— Begin, End, and Mid alignment of tracing to trigger
20.1.4
Modes of Operation
The S12XDBG module can be used in all MCU functional modes.
相關(guān)PDF資料
PDF描述
P312XDP512F0VAA Covers, S12XD, S12XB & S12XA Families
P312XDP512F0VAAR Covers, S12XD, S12XB & S12XA Families
P312XDP512F0VAG Covers, S12XD, S12XB & S12XA Families
P312XDP512F0VAGR Covers, S12XD, S12XB & S12XA Families
P312XDP512F0VAL Covers, S12XD, S12XB & S12XA Families
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
P312XDP512J1VAAR 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:HCS12X Microcontrollers
P3-13 制造商:ITT Interconnect Solutions 功能描述:P3-13 - Bulk
P3130 制造商:Switchcraft 功能描述:
P31-300 制造商:SEMIKRON 制造商全稱:Semikron International 功能描述:For stud devices
P313-001 制造商:Tripp Lite 功能描述:MINI STEREO DUBBING CORD Y ADAPTER 3.5MM M TO (2) 3.5MM F - - Bulk
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