參數(shù)資料
型號： P312XDP512F0MFV
廠商： 飛思卡爾半導(dǎo)體(中國)有限公司
英文描述： Covers, S12XD, S12XB & S12XA Families
中文描述： 封面，S12XD，S12XB
文件頁數(shù)： 694/1350頁
文件大?。?/td> 3951K
代理商： P312XDP512F0MFV
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Chapter 19 Debug (S12XDBGV2)
MC9S12XDP512 Data Sheet, Rev. 2.17
694
Freescale Semiconductor
19.1.2
Features
Four comparators (A, B, C, and D):
— Comparators A and C compare the full address and the full 16-bit data bus
— Comparators A and C feature a data bus mask register
— Comparators B and D compare the full address bus only
— Each comparator can be configured to monitor either CPU or XGATE busses
— Each comparator features control of R/W and byte/word access cycles
— Comparisons can be used as triggers for the state sequencer
Three comparator modes:
— Simple address/data comparator match mode
— Inside address range mode, Addmin
≤
Address
≤
Addmax
— Outside address range match mode, Address
<
Addmin or Address
>
Addmax
Two types of triggers:
— Tagged: triggers just before a specific instruction begins execution
— Force: triggers on the first instruction boundary after a match occurs.
Three types of breakpoints:
— CPU breakpoint entering BDM on breakpoint (BDM)
— CPU breakpoint executing SWI on breakpoint (SWI)
— XGATE breakpoint
Three trigger modes independent of comparators:
— External instruction tagging (associated with CPU instructions only)
— XGATE S/W breakpoint request
— TRIG bit immediate software trigger
Three trace modes:
— Normal: change of flow (COF) bus information is stored (see
Section 19.4.5.2.1, “Normal
Mode”
) for change of flow definition.
— Loop1: same as normal but inhibits consecutive duplicate source address entries
— Detail: address and data for all cycles except free cycles and opcode fetches are stored
4-stage state sequencer for trace buffer control:
— Tracing session trigger linked to final state of state sequencer
— Begin, end, and mid alignment of tracing to trigger
19.1.3
Modes of Operation
The DBG module can be used in all MCU functional modes.
During BDM hardware accesses and when the BDM module is active, CPU monitoring is disabled. Thus
breakpoints,comparatorsandbustracingmappedtotheCPUaredisabledbutaccessingtheDBGregisters,
including comparator registers, is still possible. While in active BDM or during hardware BDM accesses,
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