參數(shù)資料
型號(hào)： OR3T307S240-DB
廠商： LATTICE SEMICONDUCTOR CORP
元件分類： FPGA
英文描述： FPGA, 196 CLBS, 48000 GATES, PQFP240
封裝： PLASTIC, SQFP-240
文件頁數(shù)： 170/203頁
文件大小： 1368K
代理商： OR3T307S240-DB
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Lattice Semiconductor
69
Data Sheet
November 2006
ORCA Series 3C and 3T FPGAs
Microprocessor Interface (MPI) (continued)
Device ID Registers
The MPI device ID is broken into four registers holding 1 byte each. The device ID that is available through the MPI
is the same as the boundary-scan ID code, except that the device ID in the MPI has a reverse bit order. There is no
means to overwrite any of the device ID as can be done with the boundary-scan ID, but the MPI scratchpad register
can be used as a personalization register. The format for the entire device ID is shown below followed by family and
device values and the partitioning of the device ID into the four device ID registers.
Table 23. Device ID Code
* PLC array size of FPGA.
Table 24 shows the family and device values for all parts covered by this data sheet.
Table 24. Series 3 Family and Device ID Values
Table 25 describes the device IDs for all parts covered by this data sheet as they are partitioned into the four regis-
ters found in the MPI.
Table 25. ORCA Series 3 Device ID Descriptions
Version
Part
*
Family
Manufacturer
MSB
4 bits
10 bits
6 bits
11 bits
1 bit
Example: (First version of OR3C80)
0000 0110100000 110000 00000011101 1
Part Name
Family ID
(Hex)
Device ID
(Hex)
OR3T20
03
0C
OR3T30
03
0E
OR3T55
03
12
OR3C/T80
03
16
OR3T125
03
1C
Device ID Register 1
Bit 0
Logic 1. This bit is always a one.
Bits [7:1]
0011101, the 7 least signicant bits of the manufacturer ID.
Device ID Register 2
Bits [3:0]
0000, the 4 most signicant bits of the manufacturer ID.
Bits [7:4]
The 4 least signicant bits of the 10-bit part number.
Device ID Register 3
Bits [5:0]
The 6 most signicant bits of the 10-bit part number.
Bits [7:6]
The 2 least signicant bits of the device family code.
Device ID Register 4
Bits [3:0]
The 4 most signicant bits of the device family code.
Bits [7:4]
The 4-bit device version code.
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PDF描述
OR3T556PS240-DB FPGA, 324 CLBS, 80000 GATES, PQFP240
OR3T806PS240-DB FPGA, 484 CLBS, 116000 GATES, PQFP240
OR3T807PS240-DB FPGA, 484 CLBS, 116000 GATES, PQFP240
OR3T55-4BA256I FPGA, 324 CLBS, 40000 GATES, 80 MHz, PBGA256
OR3T55-4BA256 FPGA, 324 CLBS, 40000 GATES, 80 MHz, PBGA256
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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OR3T55 制造商:AGERE 制造商全稱:AGERE 功能描述:3C and 3T Field-Programmable Gate Arrays
OR3T55-4BA256I 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA)
OR3T55-4PS208I 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA)
OR3T55-4PS240I 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA)
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