參數(shù)資料
型號(hào)： OR2T04A-5S144
廠商： Electronic Theatre Controls, Inc.
元件分類： FPGA
英文描述： Field-Programmable Gate Arrays
中文描述： 現(xiàn)場(chǎng)可編程門陣列
文件頁數(shù)： 70/192頁
文件大?。?/td> 3148K
代理商： OR2T04A-5S144
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Data Sheet
June 1999
ORCA Series 2 FPGAs
70
Lucent Technologies Inc.
Pin Information
(continued)
Compatibility with Series 3 FPGAs
Pinouts for the OR2CxxA, OR2TxxA, and OR2TxxB devices will be consistent with the Series 3 FPGAs for all
devices offered in the same packages. This includes the following pins: V
DD
, V
SS
, V
DD
5 (OR3C/Txxx series only),
and all configuration pins. Identical to the OR2TxxB devices, Series 3 devices provide 5 V tolerant I/Os without a
dedicated V
DD
5 supply
The following restrictions apply:
1. There are two configuration modes supported in the OR2C/TxxA series that are
not
supported in the
Series 3 FPGAs series: master parallel down and synchronous peripheral modes. The Series 3 FPGAs have two
new microprocessor interface (MPI) configuration modes that are unavailable in the Series 2.
2. There are 4 pins—one per each device side—that are user I/O in the OR2C/TxxA series which can only be used
as fast dedicated clocks or global inputs in the Series 3 series. These pins are also used to drive the Express-
CLK to the I/O FFs on their given side of the device. These four middle ExpressCLK pins should not be used to
connect to a programmable clock manager (PCM). A corner ExpressCLK input should be used instead (see note
below). See Table 18C for a list of these pins in each package.
3. There are two other pins that are user I/O in both the Series 2 and Series 3 series but also have optional added
functionality in the Series 3 series. Each of these pins drives the ExpressCLKs on two sides of the device. They
also have fast connectivity to the programmable clock manager (PCM). See Table 18C for a preliminary list of
these pins in each package.
Note: The ECKR, ECKL, ECKT, and ECKB pins drive the ExpressCLK on their given edge of the device, while I/O—SECKLL and
I/O—SECKUR drive an ExpressCLK on two edges of the device and provide connectivity to the programmable clock manager.
Table 18C. Series 3 ExpressCLK Pins
Pin Name/
Package
ECKL
ECKB
ECKR
ECKT
I/O—SECKLL
I/O—SECKUR
208-Pin
SQFP2
22
80
131
178
49
159
240-Pin
SQFP2
26
91
152
207
56
184
256-Pin
PBGA
K3
W11
K18
B11
W1
A19
352-Pin
PBGA
N2
AE14
N23
B14
AB4
A25
432-Pin
EBGA
R29
AH16
T2
C15
AG29
D5
600-Pin
EBGA
U33
AM18
V2
C17
AK34
D5
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PDF描述
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