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參數(shù)資料
| 型號(hào)： | OR2T04A-4BC144I |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | Ceramic Chip Capacitors / MIL-PRF-55681; Capacitance [nom]: 1000pF; Working Voltage (Vdc)[max]: 100V; Capacitance Tolerance: +/-1%; Dielectric: Multilayer Ceramic; Temperature Coefficient: C0G (NP0); Lead Style: Surface Mount Chip; Lead Dimensions: 1206; Termination: Solder Coated SnPb; Body Dimensions: 0.125" x 0.062" x 0.051"; Container: Bag; Features: MIL-PRF-55681: M Failure Rate |
| 中文描述： | 現(xiàn)場(chǎng)可編程門(mén)陣列 |
| 文件頁(yè)數(shù)： | 107/192頁(yè) |
| 文件大小： | 3148K |
| 代理商： | OR2T04A-4BC144I |
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Data Sheet
June 1999
ORCA Series 2 FPGAs
Lucent Technologies Inc.
107
P4
P1
N3
R2
P3
R1
T2
R3
T1
R4
U2
T3
U1
U4
V2
U3
V1
W2
W1
V3
Y2
W4
Y1
W3
AA2
Y4
AA1
Y3
AB2
AB1
AA3
AC2
AB4
AC1
AB3
AD2
AC3
AD1
AF2
PL9C
PL9B
PL9A
PL10D
PL10C
PL10B
PL10A
PL11D
PL11C
PL11B
PL11A
PL12D
—
PL12C
—
PL12B
PL12A
PL13D
PL13C
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—
PL14C
PL14B
PL14A
—
PL15D
PL15C
PL15B
PL15A
PL16D
PL16C
PL16B
—
—
PL16A
CCLK
PB1A
PL10C
PL10B
PL10A
PL11D
PL11C
PL11B
PL11A
PL12D
PL12C
PL12B
PL12A
PL13D
PL13C
PL13B
PL13A
PL14D
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PL14B
PL14A
PL15D
PL15C
PL15B
PL15A
PL16D
PL16C
PL16B
PL16A
PL17D
PL17C
PL17B
PL17A
PL18D
PL18C
PL18B
—
—
PL18A
CCLK
PB1A
PL11C
PL11B
PL11A
PL12D
PL12C
PL12B
PL12A
PL13D
PL13C
PL13B
PL13A
PL14D
PL14C
PL14B
PL14A
PL15D
PL15C
PL15B
PL15A
PL16D
PL16C
PL16B
PL16A
PL17D
PL17C
PL17B
PL17A
PL18D
PL18C
PL18A
PL19D
PL19C
PL19A
PL20D
PL20C
PL20B
PL20A
CCLK
PB1A
PL13C
PL13B
PL13A
PL14D
PL14A
PL15D
PL15A
PL16D
PL16A
PL17D
PL17A
PL18D
PL18C
PL18B
PL18A
PL19D
PL19C
PL19B
PL19A
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PL20C
PL20B
PL20A
PL21D
PL21C
PL21B
PL21A
PL22D
PL22C
PL22A
PL23D
PL23C
PL23A
PL24D
PL24C
PL24B
PL24A
CCLK
PB1A
V
DD
5
PL16B
PL16A
PL17D
PL17A
PL18D
PL18A
PL19D
PL19A
PL20D
PL20A
PL21D
PL21C
PL21B
PL21A
PL22D
PL22C
PL22B
PL22A
PL23D
PL23C
PL24D
PL25D
PL25A
PL26C
PL26B
PL26A
V
DD
5
PL27C
PL27A
PL28D
PL28C
PL28A
PL29A
PL30C
PL30B
PL30A
PCCLK
PB1A
I/O-V
DD
5
I/O
I/O-A8
I/O-A9
I/O
I/O
I/O-A10
I/O
I/O
I/O
I/O-A11
I/O-A12
I/O
I/O
I/O
I/O
I/O
I/O-A13
I/O
I/O
I/O
I/O
I/O
I/O-A14
I/O
I/O
I/O
I/O-V
DD
5
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O-A15
CCLK
I/O-A16
Pin Information
(continued)
Table 27. OR2C/2T10A, OR2C/2T12A, OR2C/2T15A/B, OR2C/2T26A, and OR2T40A/B 352-Pin PBGA
Pinout
(continued)
Pin
2C/2T10A Pad
2C/2T12A Pad
2C/2T15A/B Pad
2C/2T26A Pad OR2T40A/B Pad
Function
Notes:
The pins labeled I/O-V
DD
5 are user I/Os for the OR2CxxA and OR2TxxB series, but they are connected to V
DD
5 for the OR2TxxA series.
The pins labeled V
SS
-ETC are the 6 x 6 array of thermal balls located at the center of the package. The balls can be attached to the ground plane
of the board for enhanced thermal capability (see Table 29), or they can be left unconnected.
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PDF描述 |
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