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參數(shù)資料
| 型號： | NB7N017MMNG |
| 廠商： | ON Semiconductor |
| 文件頁數(shù)： | 2/19頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DIVIDER 8BIT DUAL CML 52-QFN |
| 標準包裝： | 260 |
| 類型： | 時鐘除法器 |
| PLL： | 無 |
| 輸入： | CML，ECL，LVCMOS，LVDS，LVTTL |
| 輸出： | CML |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:1 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 3.5GHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | ±3 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 52-VFQFN 裸露焊盤 |
| 供應商設備封裝： | 52-QFN（8x8） |
| 包裝： | 管件 |
| 其它名稱： | NB7N017MMNG-ND NB7N017MMNGOS |
NB7N017M
http://onsemi.com
10
Table 11. AC CHARACTERISTICS VCC = 0 V; VEE = 3.465 V to 3.0 V or VCC = 3.0 V to 3.465 V; VEE = 0 V (Note 19)
Symbol
Characteristic
40°C
25°C
85°C
Unit
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
VOUTPP
Output Voltage Amplitude @ B 2 Mode
fin = 3.5 GHz
(See Figure 5)
300
400
300
400
300
400
mV
tPLH,
tPHL
Propagation Delay to Output Differential
CLK to TC
MR to TC
435
100
555
500
455
100
575
500
475
100
595
500
ps
tJITTER
RMS Random Clock Jitter fin = 3.5 GHz
(See Figure 5)
2.5
3.0
ps
VINPP
Input Voltage Swing/Sensitivity
(Differential Configuration) (Note 20)
100
2500
100
2500
100
2500
mV
tr
tf
Output Rise/Fall Times
(20% 80%)
25
45
65
25
45
65
25
45
65
ps
ts
Setup Time
Pa[7:0] to PLa
(Figure 23)
Pb[7:0] to PLb
CE to CLK
SEL to CLK
PLa to CLK
PLb to CLK
Pa[7:0] to CLK
Pb[7:0] to CLK
3750
4500
400
300
2500
3250
4750
3000
2500
2000
30
120
2000
2750
3500
2500
3750
4500
400
300
2500
3250
4750
3000
2500
2000
30
120
2000
2750
3500
2500
3750
4500
400
300
2500
3250
4750
3000
2500
2000
30
120
2000
2750
3500
2500
ps
tH
Hold Time
PLa to Pa[7:0]
(Figure 23)
PLb to Pb[7:0]
CLK to CE
CLK to SEL
CLK to PLa
CLK to PLb
CLK to PLb[7:0]
1500
1250
450
0
1750
2250
2000
2700
1900
40
110
1900
2700
3200
2500
1500
1250
450
0
1750
2250
2000
2700
1900
40
110
1900
2700
3200
2500
1500
1250
450
0
1750
2250
2000
2700
1900
40
110
1900
2700
3200
2500
ps
tSKEW
DevicetoDevice (Note 21)
40
75
40
75
40
75
ps
tPW
Minimum Pulse Width
MR
250
85
250
85
250
85
ps
tRR
Reset Recovery
MR to CLK/CLK
3000
2500
3000
2500
3000
2500
ps
NOTE: Device will meet the specifications after thermal equilibrium has been established when mounted in a test socket or printed circuit
board with maintained transverse airflow greater than 500 lfpm. Electrical parameters are guaranteed only over the declared operating
temperature range. Functional operation of the device exceeding these conditions is not implied. Device specification limit values are
applied individually under normal operating conditions and not valid simultaneously.
19.Measured using a 400 mV source, 50% duty cycle clock source at fin = 1 GHz unless stated otherwise. All loading with 50 W to VCC. Input edge
rates 40 ps (20% 80%).
20.VINPP (MAX) cannot exceed VCC VEE.
21.DevicetoDevice skew for identical transitions at identical VCC levels.
INPUT FREQUENCY (MHz)
Figure 5. Output Voltage Amplitude (VOUTPP) / RMS Jitter vs. Input Frequency (fin)
@ Ambient Temperature (Typical)
OUTPUT
VOL
TAGE
AMPLITUDE
(mV)
JITTER
OU
Tps
(RMS)
0
100
200
300
400
0
0.5
1
1.5
2
2.5
3
3.5
4
0
1
2
3
4
VOUTPP
RMS Jitter
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