參數(shù)資料
型號(hào)： MT92303
廠商： Mitel Networks Corporation
元件分類： Codec
英文描述： 3.3V Quad Interface, Dual Codec(3.3V 四接口雙編解碼器（提供音頻到PCM的接口）)
中文描述： 3.3四種接口，雙編解碼器（3.3四接口雙編解碼器（提供音頻到的PCM的接口））
文件頁(yè)數(shù)： 11/34頁(yè)
文件大?。?/td> 166K
代理商： MT92303
Preliminary Information
MT92303
11
Figure 11 - GCI Channel Allocation in a Frame Pulse
FSC
DCL
D
in
/D
out
B2
B1 B1 B1
B1
B1 B1 B1 B1
M
C/I
125us
8 GCI Channels
DCL = 4096kHz
D
in
/D
out
DCL
CH0
CH1
CH2
CH3
CH4
CH5
CH6
CH7
15.625us
1 Channel
DCL = 4096kHz
Figure 12 - Synchronous Serial Interface (SSI)
SC2
SCK
SDR
SDT
125us
Data
Data
No error checking is done so the channels defined
must be compatible with the DCL clock frequency.
In the event of codecs or status reg. erroneously
having the same channel allocation, the prioritisation
is (highest first): codec0, codec1, status. Only the
highest priority has access to the PCM channel.
Synchronous Serial Interface (SSI)
This is a commonly used standard in North America.
There is no predefined number of bits in a 125us
period, instead data is transmitted whilst the serial
chip select pin SC2 is high. Data is input on SDR,
being sampled on the falling edge of SCK, data is
output on SDT on the rising edge of SCK. Data is
arranged MSB first. The clock rate for SSI is the
same as the bit rate. See Figure 19 in the electrical
characteristics
section
information.
for
detailed
timing
Channel Definition (SSI)
In dual codec mode, codec0 data is transmitted first,
either as 8-bit companded or 16-bit linear, then
codec1 data and finally the status register. In single
codec mode, the codec data is transmitted first and
then the status register.
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