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  • 參數資料
    型號: MPC8541PXAPF
    廠商: Freescale Semiconductor
    文件頁數: 82/88頁
    文件大?。?/td> 0K
    描述: IC MPU POWERQUICC III 783-FCPBGA
    標準包裝: 36
    系列: MPC85xx
    處理器類型: 32-位 MPC85xx PowerQUICC III
    速度: 833MHz
    電壓: 1.2V
    安裝類型: 表面貼裝
    封裝/外殼: 783-BBGA,FCBGA
    供應商設備封裝: 783-FCPBGA(29x29)
    包裝: 托盤
    配用: CWH-PPC-8540N-VE-ND - KIT EVAL SYSTEM MPC8540
    MPC8541E PowerQUICC III Integrated Communications Processor Hardware Specification, Rev. 4.2
    Freescale Semiconductor
    83
    Document Revision History
    18 Document Revision History
    Table 51 provides a revision history for this hardware specification.
    Table 51. Document Revision History
    Rev. No.
    Date
    Substantive Change(s)
    4.2
    1/2008
    Added “Note: Rise/Fall Time on CPM Input Pins” and following note text to Section 10.2, “CPM AC
    4.1
    07/2007
    4
    12/2006
    Updated back page information.
    3.2
    11/2006
    3.1
    10/2005
    Table 4: Added max. power values for 1000 MHz core frequency.
    Removed Figure 3, “Maximum AC Waveforms on PCI Interface for 3.3-V Signaling.”
    Table 30: Modified note to tLBKSKEW from 8 to 9
    Table 30: Changed tLBKHOZ1 and tLBKHOV2 values.
    Table 30: Added note 3 to tLBKHOV1.
    Table 30 and Table 31: Modified note 3.
    Table 31: Added note 3 to tLBKLOV1.
    Table 31: Modified values for tLBKHKT, tLBKLOV1, tLBKLOV2, tLBKLOV3, tLBKLOZ1, and tLBKLOZ2.
    Figure 21: Changed Input Signals: LAD[0:31]/LDP[0:3].
    Table 43: Modified note for signal CLK_OUT.
    Table 43: PCI1_CLK and PCI2_CLK changed from I/O to I.
    Table 52: Added column for Encryption Acceleration.
    3
    8/29/2005
    Table 4: Modified max. power values.
    Table 43: Modified notes for signals TSEC1_TXD[3:0], TSEC2_TXD[3:0], TRIG_OUT/READY,
    MSRCID4, and MDVAL.
    2
    8/2005
    Previous revision’s history listed incorrect cross references. Table 2 is now correctly listed as
    Table 27 and Table 31 is now listed as Table 31.
    Table 7: Added note 2.
    Table 14: Modified min and max values for tDDKHMP
    1
    6/2005
    Table 27: Changed LVdd to OVdd for the supply voltage Ethernet management interface.
    Table 4: Modified footnote 4 and changed typical power for the 1000MHz core frequency.
    Table 31: Corrected symbols for body rows 9–15, effectively changing them from a high state to a
    0
    6/2005
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