參數(shù)資料
型號(hào): MK1704SLF
廠商: INTEGRATED DEVICE TECHNOLOGY INC
元件分類: 時(shí)鐘產(chǎn)生/分配
英文描述: 65 MHz, VIDEO CLOCK GENERATOR, PDSO8
封裝: SOIC-8
文件頁(yè)數(shù): 2/4頁(yè)
文件大小: 54K
代理商: MK1704SLF
MK1704
Low EMI Clock Generator
MDS1704F
2
Revision 4298
Printed 4/29/98
MicroClock Division of ICS1271 Parkmoor Ave.San JoseCA95126(408)295-9800tel(408)295-9818fax
ICRO
CLOCK
Pin #
Name
Type Description
1
X1/ICLK
I
Connect to a crystal or clock as shown in the table above.
2
VDD
P
Connect to +3.3V or +5V.
3
GND
P
Connect to ground.
4
CLK
O
Clock Output per table above.
5
LEE
I
Low EMI Enable. Turns on the spread spectrum when high. Internal pull-up.
6
S1
I
Frequency Select 1 Input. Selects input/output clock range per table above.
7
S0
I
Frequency Select 0 Input. Selects input/output clock range per table above.
8
X2
O
Crystal Connection. Leave unconnected for a clock input.
Pin Descriptions
Key: I = Input, O = output, P = power supply connection
Pin Assignment
External Components
A minimum number of external components are required for proper operation. A decoupling capacitor of
0.1F should be connected between VDD and GND on pins 2 and 3, and a 33
terminating resistor may
be used on the clock output if the trace is longer than 1 inch. Operation with a crystal requires a parallel
resonant, fundamental mode crystal. Consult MicroClock for more infomation if a crystal is used instead
of a clock input.
1
8
2
3
4
7
6
5
X1/ICLK
S0
GND
X2
VDD
LEE
8 pin SOIC
CLK
S1
S1
S0
Input
CLK
Mode
Frequency spread
pin 6
pin 7
pin 1
pin 4
vs. CLK
0
80
*
Down 1.25%
0
1
135
*
Down 1.25%
1
0
40
SVGA
Down 2.5%
1
65
XGA
Down 1.25%
Clock Output Select Table (in MHz)
*Note: Only the MK1704A is designed for operation
at these higher frequencies. Either the MK1704S or
MK1704A may be used for SVGA and XGA.
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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