參數(shù)資料
型號(hào)： MCF5251VM140
廠商： 飛思卡爾半導(dǎo)體(中國(guó))有限公司
英文描述： ColdFire Processor
中文描述： ColdFire處理器
文件頁(yè)數(shù)： 14/32頁(yè)
文件大?。?/td> 290K
代理商： MCF5251VM140
Electrical Specifications
MCF5251 ColdFire Processor Data Sheet: Technical Data, Rev. 2.1
14
Freescale Semiconductor
Figure 2
and
Table 10
provide the clock timing diagram and timing parameters.
Figure 2. Clock Timing Definition
NOTE
Signals shown in
Figure 2
are in relation to the SYSCLK clock. No
relationship between signals is implied or intended.
4.1
SDRAM Bus Timing
The SDRAM bus is a synchronous bus. Propagation delays, set-up times and hold times with respect to
the SDRAM clock BCLK are shown in
Figure 3
and the parameters provided in
Table 11
. When BCLK
clock is not active, SDRAM interface is not valid and the external bus cannot be used.
Table 10. Clock Timing Parameters
ID
Characteristic
140 MHz CPU
Units
Min
Max
–
CRIN Frequency with external oscillator
5.00
33.86
MHz
–
CRIN Frequency with internal oscillator
5
16.94
MHz
C5
PSTCLK cycle time
7
–
ns
C6
PSTCLK duty cycle
40
60
%
C7
BCLK cycle time
14.0
–
ns
C8
BCLK duty cycle
35
65
%
CRIN
C5
C7
C8
C8
C6
C6
PSTCLK
BCLK
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