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參數(shù)資料
| 型號： | MCF5208CAB166 |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | Microprocessor Data Sheet |
| 中文描述： | 微處理器數(shù)據(jù)表 |
| 文件頁數(shù)： | 25/46頁 |
| 文件大?。?/td> | 936K |
| 代理商： | MCF5208CAB166 |
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Preliminary Electrical Characteristics
MCF5208 ColdFire
Microprocessor Data Sheet, Rev. 0.5
Preliminary
Freescale Semiconductor
25
Figure 13. General Input Timing Requirements
5.6.1
FlexBus
A multi-function external bus interface called FlexBus is provided to interface to slave-only devices up to
a maximum bus frequency of 83.33 MHz. It can be directly connected to asynchronous or synchronous
devices such as external boot ROMs, Flash memories, gate-array logic, or other simple target (slave)
devices with little or no additional circuitry. For asynchronous devices a simple chip-select based interface
can be used. The FlexBus interface has six general purpose chip-selects (FB_CS[5:0]) which can be
configured to be distributed between the FlexBus or SDRAM memory interfaces. Chip-select FB_CS[0]
can be dedicated to boot ROM access and can be programmed to be byte (8 bits), word (16 bits), or
longword (32 bits) wide. Control signal timing is compatible with common ROM/Flash memories.
5.6.1.1
The following timing numbers indicate when data will be latched or driven onto the external bus, relative
to the system clock.
FlexBus AC Timing Characteristics
Table 9. FlexBus AC Timing Specifications
Num
Characteristic
Symbol
Min
Max
Unit
Notes
Frequency of Operation
83.33
Mhz
f
sys/2
FB1
Clock Period (FB_CLK)
t
FBCK
12
ns
t
cyc
Invalid
Invalid
FB_CLK(75MHz)
T
SETUP
T
HOLD
Input Setup And Hold
1.5V
t
rise
V
h
= V
IH
V
l
= V
IL
1.5V
1.5V
Valid
t
fall
V
h
= V
IH
V
l
= V
IL
Input Rise Time
Input Fall Time
* The timings are also valid for inputs sampled on the negative clock edge.
Inputs
FB_CLK
FB4
FB5
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