參數(shù)資料
型號： MC9S12E32
廠商： Motorola, Inc.
英文描述： MC9S12E-Family Device User Guide V01.04
中文描述： MC9S12E -系列設(shè)備的用戶手冊V01.04
文件頁數(shù)： 95/156頁
文件大?。?/td> 3077K
代理商： MC9S12E32
95
Section 5 Resets and Interrupts
5.1 Overview
Consult the Exception Processing section of the CPU12 Reference Manual for information on resets and
interrupts. System resets can be generated through external control of the RESET pin, through the clock
and reset generator module CRG or through the low voltage reset (LVR) generator of the voltage regulator
module. Refer to the CRG and VREG Block Guides for detailed information on reset generation.
5.2 Vectors
Table 5-1
lists interrupt sources and vectors in default order of priority.
Table 5-1 Interrupt Vector Locations
Vector Address
Interrupt Source
CCR
Mask
Local Enable
HPRIO Value
to Elevate
$FFFE, $FFFF
External Reset, Power On Reset or Low
Voltage Reset (see CRG Flags Register
to determine reset source)
Clock Monitor fail reset
COP failure reset
Unimplemented instruction trap
SWI
XIRQ
IRQ
Real Time Interrupt
None
None
–
$FFFC, $FFFD
$FFFA, $FFFB
$FFF8, $FFF9
$FFF6, $FFF7
$FFF4, $FFF5
$FFF2, $FFF3
$FFF0, $FFF1
$FFE8 to $FFEF
$FFE6, $FFE7
$FFE4, $FFE5
$FFE2, $FFE3
$FFE0, $FFE1
$FFDE, $FFDF
$FFDC, $FFDD
$FFDA, $FFDB
$FFD8, $FFD9
None
None
None
None
X-Bit
I-Bit
I-Bit
Reserved
I-Bit
I-Bit
I-Bit
I-Bit
I-Bit
I-Bit
I-Bit
I-Bit
COPCTL (CME, FCME)
COP rate select
None
None
None
INTCR (IRQEN)
CRGINT (RTIE)
–
–
–
–
–
$F2
$F0
Standard Timer 0 channel 4
Standard Timer 0 channel 5
Standard Timer 0 channel 6
Standard Timer 0 channel 7
Standard Timer overflow
Pulse accumulator overflow
Pulse accumulator input edge
SPI
TIE (C4I)
TIE (C5I)
TIE (C6I)
TIE (C7I)
TSCR2 (TOI)
PACTL(PAOVI)
PACTL (PAI)
SPICR1 (SPIE, SPTIE)
SCICR2
(TIE, TCIE, RIE, ILIE)
SCICR2
(TIE, TCIE, RIE, ILIE)
SCICR2
(TIE, TCIE, RIE, ILIE)
ATDCTL2 (ASCIE)
PTADIF (PTADIE)
Reserved
I-Bit
PLLCR (LOCKIE)
I-Bit
PLLCR (SCMIE)
$E6
$E4
$E2
$E0
$DE
$DC
$DA
$D8
$FFD6, $FFD7
SCI0
I-Bit
$D6
$FFD4, $FFD5
SCI1
I-Bit
$D4
$FFD2, $FFD3
SCI2
I-Bit
$D2
$FFD0, $FFD1
$FFCE, $FFCF
$FFC8 to $FFCD
$FFC6, $FFC7
$FFC4, $FFC5
ATD
I-Bit
I-Bit
$D0
$CE
Port AD (KWU)
CRG PLL lock
CRG Self Clock Mode
$C6
$C4
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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