參數(shù)資料
型號： MC908KX8VPE
廠商： Freescale Semiconductor
文件頁數(shù)： 74/210頁
文件大?。?/td> 0K
描述： IC MCU 8MHZ 8K FLASH 16-DIP
標(biāo)準(zhǔn)包裝： 25
系列： HC08
核心處理器： HC08
芯體尺寸： 8-位
速度： 8MHz
連通性： SCI
外圍設(shè)備： LVD，POR，PWM
輸入/輸出數(shù)： 13
程序存儲(chǔ)器容量： 8KB（8K x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 192 x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 4x8b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 105°C
封裝/外殼： 16-DIP（0.300"，7.62mm）
包裝： 管件
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I/O Registers
MC68HC908KX8 MC68HC908KX2 MC68HC08KX8 Data Sheet, Rev. 2.1
Freescale Semiconductor
165
15.8.3 TIM Counter Modulo Registers
The read/write TIM modulo registers (TMODH and TMODL) contain the modulo value for the TIM counter.
When the TIM counter reaches the modulo value, the overflow flag (TOF) becomes set, and the TIM
counter resumes counting from $0000 at the next timer clock. Writing to the high byte (TMODH) inhibits
the TOF bit and overflow interrupts until the low byte (TMODL) is written. Reset sets the TIM counter
modulo registers.
NOTE
Reset the TIM counter before writing to the TIM counter modulo registers.
15.8.4 TIM Channel Status and Control Registers
Each of the TIM channel status and control registers (TSC0 and TSC1):
Flags input captures and output compares
Enables input capture and output compare interrupts
Selects input capture, output compare, or PWM operation
Selects high, low, or toggling output on output compare
Selects rising edge, falling edge, or any edge as the active input capture trigger
Selects output toggling on TIM overflow
Selects 0 percent and100 percent PWM duty cycle
Selects buffered or unbuffered output compare/PWM operation
Register name and address:
TMODH — $0023
Bit 7
654321
Bit 0
Read:
Bit 15
14
13
12
11
10
9
Bit 8
Write:
Reset:
11111111
Register name and address:
TMODL — $0024
Bit 7
654321
Bit 0
Read:
Bit 7
654321
Bit 0
Write:
Reset:
11111111
Figure 15-7. TIM Counter Modulo Registers (TMODH and TMODL)
Register name and address:
TSC0 — $0025
Bit 7
654321
Bit 0
Read:
CH0F
CH0IE
MS0B
MS0A
ELS0B
ELS0A
TOV0
CH0MAX
Write:
0
Reset:
0000000
0
Register name and address:
TSC1 — $0028
Bit 7
654321
Bit 0
Read:
CH1F
CH1IE
0
MS1A
ELS1B
ELS1A
TOV1
CH1MAX
Write:
0
Reset:
0000000
0
= Unimplemented
Figure 15-8. TIM Channel Status and Control Registers (TSCO and TSC1)
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PDF描述
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