參數(shù)資料
型號： MC68HC912B32CFU8
廠商： Freescale Semiconductor
文件頁數(shù)： 148/334頁
文件大?。?/td> 0K
描述： IC MCU 32K FLASH 8MHZ 80-QFP
標(biāo)準(zhǔn)包裝： 84
系列： HC12
核心處理器： CPU12
芯體尺寸： 16-位
速度： 8MHz
連通性： SCI，SPI
外圍設(shè)備： POR，PWM，WDT
輸入/輸出數(shù)： 63
程序存儲器容量： 32KB（32K x 8）
程序存儲器類型： 閃存
EEPROM 大小： 768 x 8
RAM 容量： 1K x 8
電壓 - 電源 (Vcc/Vdd)： 4.5 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 80-QFP
包裝： 托盤
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BDLC Registers
M68HC12B Family Data Sheet, Rev. 9.1
Freescale Semiconductor
231
The BDLC cannot transmit a BREAK symbol. It can receive a BREAK symbol only from the J1850 bus.
15.8.5.5 Summary
Table 15-1 provides a bus error summary.
15.9 BDLC Registers
Eight registers are available for controlling operation of the BDLC and for communicating data and status
information. A full description of each register is given here.
15.9.1 BDLC Control Register 1
IMSG — Ignore Message Bit
This bit disables the receiver until a new start-of-frame (SOF) is detected. The bit is cleared
automatically by the reception of an SOF symbol or a BREAK symbol. It then generates interrupt
requests and allows changes of the status register to occur. However, these interrupts may still be
masked by the interrupt enable (IE) bit. When set, all BDLC interrupt requests are masked (except $20
in BSVR) and the status bits are held in their reset state. If this bit is set while the BDLC is receiving a
message, the rest of the incoming message is ignored.
1 = Disable receiver
0 = Enable receiver
Table 15-1. BDLC J1850 Bus Error Summary
Error Condition
BDLC Function
Transmission error
For invalid bits or framing symbols on non-byte boundaries, invalid symbol interrupt
is generated. BDLC stops transmission.
Cyclical redundancy check
(CRC) error
CRC error interrupt is generated.
BDLC waits for EOF.
Invalid symbol: BDLC transmits,
but receives invalid bits (noise)
The BDLC aborts transmission immediately. Invalid symbol interrupt is generated.
Framing error
Invalid symbol interrupt is generated. BDLC waits for end of frame (EOF).
Bus short to VDD
The BDLC does not transmit until the bus is idle. Invalid symbol interrupt is generated.
EOF interrupt also must be seen before another transmission attempt. Depending on
length of the short, LOA flag also may be set.
Bus short to GND
Thermal overload shuts down physical interface. Fault condition is seen as invalid
symbol flag. EOF interrupt must also be seen before another transmission attempt.
BDLC receives BREAK symbol
Invalid symbol interrupt is generated. BDLC waits for the next valid SOF.
Address: $00F8
Bit 7
6
5
4321
Bit 0
Read:
IMSG
CLKS
R1
R0
00
IE
WCM
Write:
R
Reset:
111
00000
R
= Reserved
Figure 15-12. BDLC Control Register 1 (BCR1)
相關(guān)PDF資料
PDF描述
MC68HC98LJ12CFUE IC MCU 12K FLASH 8MHZ 64-QFP
MC68HRC908JK3CP IC MCU FLASH 8B 8MHZ RC 4K 20DIP
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MC68LC060RC66 IC MPU 32BIT 66MHZ 206-PGA
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參數(shù)描述
MC68HC916P1CAA16 功能描述:16位微控制器 - MCU 16B MCU 32K FLASH RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數(shù)據(jù)總線寬度:16 bit 最大時鐘頻率:24 MHz 程序存儲器大小:8 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風(fēng)格:SMD/SMT
MC68HC916P1CFU16 制造商:Rochester Electronics LLC 功能描述:16BIT W/32KB FLASH EEPRO - Bulk
MC68HC916P1VAA16 功能描述:IC MCU 32K FLASH 16MHZ 80-QFP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:HC16 標(biāo)準(zhǔn)包裝:1 系列:AVR® ATmega 核心處理器:AVR 芯體尺寸:8-位 速度:16MHz 連通性:I²C，SPI，UART/USART 外圍設(shè)備:欠壓檢測/復(fù)位，POR，PWM，WDT 輸入/輸出數(shù):32 程序存儲器容量:32KB（16K x 16） 程序存儲器類型:閃存 EEPROM 大小:1K x 8 RAM 容量:2K x 8 電壓 - 電源 (Vcc/Vdd):2.7 V ~ 5.5 V 數(shù)據(jù)轉(zhuǎn)換器:A/D 8x10b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 125°C 封裝/外殼:44-TQFP 包裝:剪切帶 (CT) 其它名稱:ATMEGA324P-B15AZCT
MC68HC916P3CFU16 制造商:Rochester Electronics LLC 功能描述:16BIT MCU FOR GENERAL - Bulk
MC68HC98LJ12CFU 制造商:Rochester Electronics LLC 功能描述: 制造商:Freescale Semiconductor 功能描述:
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