參數(shù)資料
型號(hào)： MC68HC908KX8CP
廠商： Freescale Semiconductor
文件頁數(shù)： 6/210頁
文件大?。?/td> 0K
描述： IC MCU 8MHZ 8K FLASH 16-DIP
標(biāo)準(zhǔn)包裝： 25
系列： HC08
核心處理器： HC08
芯體尺寸： 8-位
速度： 8MHz
連通性： SCI
外圍設(shè)備： LVD，POR，PWM
輸入/輸出數(shù)： 13
程序存儲(chǔ)器容量： 8KB（8K x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 192 x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 4x8b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 16-DIP（0.300"，7.62mm）
包裝： 管件
配用： RD3112MMA7260QE-ND - BOARD DEMO STAR FOR MMA7260QT
RD1986MMA2260D-ND - KIT SENSOR ACCEL MMA2260D TRIAX
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LVI Status Register
MC68HC908KX8 MC68HC908KX2 MC68HC08KX8 Data Sheet, Rev. 2.1
Freescale Semiconductor
103
10.4 LVI Status Register
The LVI status register (LVISR) indicates if the VDD voltage was detected below the VTRIPF level while LVI
resets have been disabled.
LVIOUT — LVI Output Bit
This read-only flag becomes set when the VDD voltage falls below the VTRIPF trip voltage and is cleared
when VDD voltage rises above VTRIPR. The difference in these threshold levels results in a hysteresis
that prevents oscillation into and out of reset. (See Table 10-1.) Reset clears the LVIOUT bit.
10.5 LVI Interrupts
The LVI module does not generate interrupt requests.
10.6 Low-Power Modes
The STOP and WAIT instructions put the MCU in low power-consumption standby modes.
10.6.1 Wait Mode
If enabled, the LVI module remains active in wait mode. If enabled to generate resets, the LVI module can
generate a reset and bring the MCU out of wait mode.
10.6.2 Stop Mode
When the LVIPWRD bit in the configuration register is cleared and the LVISTOP bit in the configuration
register is set, the LVI module remains active in stop mode. If enabled to generate resets, the LVI module
can generate a reset and bring the MCU out of stop mode.
Address: $FE0C
Bit 7
6
54
32
1
Bit 0
Read:
LVIOUT
0
00
0
R
Write:
Reset:
000
00
0
= Unimplemented
R
= Reserved
Figure 10-2. LVI Status Register (LVISR)
Table 10-1. LVIOUT Bit Indication
VDD
LVIOUT
VDD > VTRIPR
0
VDD < VTRIPF
1
VTRIPF < VDD < VTRIPR
Previous value
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PDF描述
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