參數(shù)資料
型號(hào)： MC68HC908GR8BMFA
廠商： 飛思卡爾半導(dǎo)體(中國)有限公司
英文描述： Microcontrollers
中文描述： 微控制器
文件頁數(shù)： 234/260頁
文件大?。?/td> 1349K
代理商： MC68HC908GR8BMFA
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Electrical Specifications
MC68HC908GR8B Data Sheet, Rev. 3.0
234
Freescale Semiconductor
Low-voltage inhibit, trip falling voltage – target
V
TRIPF
V
TRIPR
2.35
2.60
2.70
V
Low-voltage inhibit, trip rising voltage – target
2.45
2.66
2.80
V
Low-voltage inhibit reset/recover hysteresis – target
(V
TRIPF
+ V
HYS
= V
TRIPR
)
V
HYS
—
60
—
mV
Input hysteresis (alternative input functions only)
(6), (11)
V
InHYS
0.06 x V
DD
—
—
V
POR rearm voltage
(12)
V
POR
V
PORRST
0
—
100
mV
POR reset voltage
(13)
0
700
800
mV
POR rise time ramp rate
(14)
R
POR
0.02
—
—
V/ms
1. V
DD
= 3.0 Vdc
±
10%, V
SS
= 0 Vdc, T
A
= T
L
to T
H
, unless otherwise noted
2. Typical values reflect average measurements at midpoint of voltage range, 25
°
C only.
3. Run (operating) I
DD
measured using external square wave clock source (f
osc
= 16.4 MHz). All inputs 0.2 V from rail. No dc
loads. Less than 100 pF on all outputs. C
L
= 20 pF on OSC2. All ports configured as inputs. OSC2 capacitance linearly
affects run I
DD
. Measured with all modules enabled.
4. Wait I
DD
measured using external square wave clock source (f
osc
= 16.4 MHz). All inputs 0.2 V from rail. No dc loads. Less
than 100 pF on all outputs. C
L
= 20 pF on OSC2. All ports configured as inputs. OSC2 capacitance linearly affects wait
I
DD
. Measured with PLL and LVI enabled.
5. Stop I
DD
with TBM enabled is measured using an external crystal clock source (f
OSC
= 4 MHz). All inputs 0.2 V from rail.
No dc loads. Less than 100 pF on all outputs. All inputs configured as inputs.
6. This parameter is characterized and not tested on each device.
7. All functional non-supply pins are internally clamped to V
SS
and V
DD
.
8. Input must be current limited to the value specified. To determine the value of the required current-limiting resistor, calcu-
late resistance values for positive and negative clamp voltages, then use the larger of the two values.
9. Power supply must maintain regulation within operating V
DD
range during instantaneous and operating maximum current
conditions. If positive injection current (V
IN
> V
DD
) is greater than I
DD
, the injection current may flow out of V
DD
and could
result in external power supply going out of regulation. Ensure external V
DD
load will shunt current greater than maximum
injection current. This will be the greatest risk when the MCU is not consuming power. Examples are: if no system clock is
present, or if clock rate is very low (which would reduce overall power consumption).
10. Pullups and pulldowns are disabled.
11. Digital inputs have hysteresis whenever they are configured for any alternative peripheral input function other than as a
general-purpose input.
12. Maximum is highest voltage that POR is guaranteed.
13. Maximum is highest voltage that POR is possible.
14. If minimum V
DD
is not reached before the internal POR reset is released, RST must be driven low externally until minimum
V
DD
is reached.
Characteristic
(1)
Symbol
Min
Typ
(2)
Max
Unit
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PDF描述
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