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參數(shù)資料
| 型號： | MC68HC811D3CFU |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | ROM-based high-performance microcontrollers |
| 中文描述： | 基于ROM的高性能微控制器 |
| 文件頁數(shù)： | 28/124頁 |
| 文件大?。?/td> | 840K |
| 代理商： | MC68HC811D3CFU |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁當(dāng)前第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁
CENTRAL PROCESSING UNIT
3-8
TECHNICAL DATA
3.5 Instruction Set
Refer to
Table 3-2
, which shows all the M68HC11 instructions in all possible address-
ing modes. For each instruction, the table shows the operand construction, the number
of machine code bytes, and execution time in CPU E-clock cycles.
Table 3-2 Instruction Set (Sheet 1 of 7)
Mnemonic
Operation
Description
Addressing
Mode
INH
Instruction
Operand
1B
Condition Codes
H
I
—
Opcode
Cycles
2
S
—
X
—
N
Z
V
C
ABA
Add
Accumulators
Add B to X
Add B to Y
Add with Carry
to A
A + B
A
—
ABX
ABY
IX + (00 : B)
IX
IY + (00 : B)
IY
A + M + C
A
INH
INH
IMM
DIR
EXT
IND,X
IND,Y
IMM
DIR
EXT
IND,X
IND,Y
IMM
DIR
EXT
IND,X
IND,Y
IMM
DIR
EXT
IND,X
IND,Y
IMM
DIR
EXT
IND,X
IND,Y
IMM
DIR
EXT
IND,X
IND,Y
IMM
DIR
EXT
IND,X
IND,Y
EXT
IND,X
IND,Y
INH
3A
3A
89
99
B9
A9
A9
C9
D9
F9
E9
E9
8B
9B
BB
AB
AB
CB
DB
FB
EB
EB
C3
D3
F3
E3
E3
84
94
B4
A4
A4
C4
D4
F4
E4
E4
78
68
68
48
—
—
3
4
2
3
4
4
5
2
3
4
4
5
2
3
4
4
5
2
3
4
4
5
4
5
6
6
7
2
3
4
4
5
2
3
4
4
5
6
6
7
2
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
—
18
ADCA (opr)
A
A
A
A
A
B
B
B
B
B
A
A
A
A
A
B
B
B
B
B
18
ii
dd
hh ll
ff
ff
ii
dd
hh ll
ff
ff
ii
dd
hh ll
ff
ff
ii
dd
hh ll
ff
ff
jj kk
dd
hh ll
ff
ff
ii
dd
hh ll
ff
ff
ii
dd
hh ll
ff
ff
hh ll
ff
ff
ADCB (opr)
Add with Carry
to B
B + M + C
B
18
—
—
—
ADDA (opr)
Add Memory
to A
A + M
A
18
—
—
—
ADDB (opr)
Add Memory
to B
B + M
B
18
—
—
—
ADDD (opr)
Add 16-Bit to D D + (M : M + 1)
D
18
—
—
—
—
ANDA (opr)
AND A with
Memory
A M
A
A
A
A
A
A
B
B
B
B
B
18
—
—
—
0
—
ANDB (opr)
AND B with
Memory
B M
B
18
—
—
—
—
0
—
ASL (opr)
Arithmetic
Shift Left
18
—
—
—
—
ASLA
Arithmetic
Shift Left A
A
—
—
—
—
—
ASLB
Arithmetic
Shift Left B
B
INH
58
—
2
—
—
—
—
ASLD
Arithmetic
Shift Left D
INH
05
—
3
—
—
—
—
ASR
Arithmetic
Shift Right
EXT
IND,X
IND,Y
INH
77
67
67
47
18
hh ll
ff
ff
6
6
7
2
—
—
—
—
ASRA
Arithmetic
Shift Right A
A
—
—
—
—
—
ASRB
Arithmetic
Shift Right B
B
INH
57
—
2
—
—
—
—
BCC (rel)
Branch if Carry
Clear
C = 0
REL
24
rr
3
—
—
—
—
—
—
—
—
C
0
b7
b0
C
0
b7
b0
C
0
b7
b0
C
0
b7
b0
A
B
b7
b0
C
b7
b0
C
b7
b0
C
b7
b0
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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PDF描述 |
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