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參數(shù)資料
| 型號： | MC68HC11A0FU |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | ROM-based high-performance microcontrollers |
| 中文描述： | 基于ROM的高性能微控制器 |
| 文件頁數(shù)： | 115/124頁 |
| 文件大?。?/td> | 840K |
| 代理商： | MC68HC11A0FU |
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ELECTRICAL CHARACTERISTICS
TECHNICAL DATA
A-11
NOTES:
1. All timing is shown with respect to 20% V
DD
and 70% V
DD
, unless otherwise noted.
2. Signal production depends on software.
3. Assumes 100 pF load on all SPI pins.
Table A-7 Serial Peripheral Interface Timing
Num
Characteristic
Symbol
2.0 MHz
Min
3.0 MHz
Min
Unit
Max
Max
Operating Frequency
Master
Slave
Cycle Time
Master
Slave
Enable Lead Time
Master (Note 2)
Slave
Enable Lag Time
Master (Note 2)
Slave
Clock (SCK) High Time
Master
Slave
Clock (SCK) Low Time
Master
Slave
Data Setup Time (Inputs)
Master
Slave
Data Hold Time (Inputs)
Master
Slave
Access Time
(Time to Data Active from High-Imp. State)
Slave
Disable Time
(Hold Time to High-Impedance State)
Slave
Data Valid (After Enable Edge) (Note 3)
Data Hold Time (Outputs) (After Enable Edge)
Rise Time (20% V
DD
to 70% V
DD
, C
L
= 200 pF)
SPI Outputs (SCK, MOSI, and MISO)
SPI Inputs (SCK, MOSI, MISO, and SS)
Fall Time (70% V
DD
to 20% V
DD
, C
L
= 200 pF)
SPI Outputs (SCK, MOSI, and MISO)
SPI Inputs (SCK, MOSI, MISO, and SS)
f
op(m)
f
op(s)
dc
dc
0.5
2.0
dc
dc
0.5
3.0
f
op
MHz
1
t
cyc(m)
t
cyc(s)
2.0
500
—
—
2.0
333
—
—
t
cyc
ns
2
t
lead(m)
t
lead(s)
—
250
—
—
—
240
—
—
ns
ns
3
t
lag(m)
t
lag(s)
—
250
—
—
—
240
—
—
ns
ns
4
t
w(SCKH)m
t
w(SCKH)s
340
190
—
—
340
190
—
—
ns
ns
5
t
w(SCKL)m
t
w(SCKL)s
340
190
—
—
340
190
—
—
ns
ns
6
t
su(m)
t
su(s)
100
100
—
—
100
100
—
—
ns
ns
7
t
h(m)
t
h(s)
100
100
—
—
100
100
—
—
ns
ns
8
t
a
0
120
0
120
ns
9
t
dis
t
v(s)
t
ho
—
—
0
240
240
—
—
—
0
167
167
—
ns
ns
ns
10
11
12
t
rm
t
rs
—
—
100
2.0
—
—
100
2.0
ns
μs
13
t
fm
t
fs
—
—
100
2.0
—
—
100
2.0
ns
μs
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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PDF描述 |
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