• 參數(shù)資料
    型號: MC68020RC16E
    廠商: Freescale Semiconductor
    文件頁數(shù): 205/306頁
    文件大?。?/td> 0K
    描述: IC MPU 32BIT 16MHZ 114-PGA
    標(biāo)準(zhǔn)包裝: 14
    系列: M680x0
    處理器類型: M680x0 32-位
    速度: 16MHz
    電壓: 5V
    安裝類型: 通孔
    封裝/外殼: 114-BPGA
    供應(yīng)商設(shè)備封裝: 114-PGA(34.54x34.54)
    包裝: 托盤
    第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁當(dāng)前第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁第253頁第254頁第255頁第256頁第257頁第258頁第259頁第260頁第261頁第262頁第263頁第264頁第265頁第266頁第267頁第268頁第269頁第270頁第271頁第272頁第273頁第274頁第275頁第276頁第277頁第278頁第279頁第280頁第281頁第282頁第283頁第284頁第285頁第286頁第287頁第288頁第289頁第290頁第291頁第292頁第293頁第294頁第295頁第296頁第297頁第298頁第299頁第300頁第301頁第302頁第303頁第304頁第305頁第306頁
    MOTOROLA
    M68020 USERS MANUAL
    10-9
    AC ELECTRICAL CHARACTERISTICSREAD AND WRITE CYCLES
    (Continued)
    16.67 MHz
    20 MHz
    25 MHz
    **
    33.33 MHz
    Num.
    Characteristics
    Min
    Max
    Min
    Max
    Min
    Max
    Min
    Max
    Unit
    29
    AS, DS Negated to Data-In Invalid
    (Data-In Hold Time)
    0
    0
    00ns
    29A
    AS, DS Negated to Data-In
    (High Impedance)
    60
    50
    40
    30
    ns
    30
    Clock Low to Data-In Invalid
    (Data-In Hold Time)
    15
    15
    10
    10
    ns
    312
    DSACK
    Asserted to Data-In Valid
    50
    43
    32
    17
    ns
    31A3
    DSACK
    Asserted to DSACK Valid
    (
    DSACK
    Asserted Skew)
    15
    10
    10
    10
    ns
    32
    RESET Input Transition Time
    1.5
    1.5
    1.5
    1.5
    Clks
    33
    Clock Low to
    BG Asserted
    0
    30
    0
    25
    0
    20
    0
    20
    ns
    34
    Clock Low to
    BG Negated
    0
    30
    0
    25
    0
    20
    0
    20
    ns
    35
    BR Asserted to BG Asserted (RMC Not
    Asserted)
    1.5
    3.5
    1.5
    3.5
    1.5
    3.5
    1.5
    3.5
    Clks
    *37
    BGACK Asserted to BG Negated
    1.5
    3.5
    1.5
    3.5
    1.5
    3.5
    1.5
    3.5
    Clks
    *37A6 BGACK Asserted to BR Negated
    0
    1.5
    0
    1.5
    0
    1.5
    0
    1.5
    Clks
    39
    BG Width Negated
    90
    75
    60
    50
    ns
    39A
    BG Width Asserted
    90
    75
    60
    50
    ns
    *40
    Clock High to
    DBEN Asserted (Read)
    0
    30
    0
    25
    0
    20
    0
    15
    ns
    *41
    Clock Low to
    DBEN Negated (Read)
    0
    30
    0
    25
    0
    20
    0
    15
    ns
    *42
    Clock Low to
    DBEN Asserted (Write)
    0
    30
    0
    25
    0
    20
    0
    15
    ns
    *43
    Clock High to
    DBEN Negated (Write)
    0
    30
    0
    25
    0
    20
    0
    15
    ns
    *44
    R/
    W Low to DBEN Asserted (Write)
    15
    10
    10
    5ns
    *455
    DBEN Width Asserted
    Read
    Write
    60
    120
    50
    100
    40
    80
    30
    60
    ns
    46
    R/
    W Width Valid (Write or Read)
    150
    125
    100
    75
    ns
    47A
    Asynchronous Input Setup Time
    5
    5
    55ns
    47B
    Asynchronous Input Hold Time
    15
    15
    10
    10
    ns
    484
    DSACK
    Asserted to BERR, HALT Asserted
    30
    20
    18
    15
    ns
    53
    Data-Out Hold from Clock High
    0
    0
    00ns
    55
    R/
    W Valid to Data Bus Impedance Change
    30
    25
    20
    20
    ns
    56
    RESET Pulse Width (Reset Instruction)
    512
    512
    512
    512
    Clks
    57
    BERR Negated to HALT Negated (Rerun)
    0
    0
    00ns
    *5810 BGACK Negated to Bus Driven
    1
    1
    11
    Clks
    5910
    BG Negated to Bus Driven
    1
    1
    11
    Clks
    *This specification does not apply to the MC68EC020.
    **These specifications represent an improvement over previously published specifications for the 25-MHz MC68020
    and are valid only for product bearing date codes of 8827 and later.
    F
    re
    e
    sc
    a
    le
    S
    e
    m
    ic
    o
    n
    d
    u
    c
    to
    r,
    I
    Freescale Semiconductor, Inc.
    For More Information On This Product,
    Go to: www.freescale.com
    n
    c
    ..
    .
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    PDF描述
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