參數(shù)資料
型號： MC56F8167E
廠商： 飛思卡爾半導(dǎo)體(中國)有限公司
英文描述： 16-bit Digital Signal Controllers
中文描述： 16位數(shù)字信號控制器
文件頁數(shù)： 149/180頁
文件大?。?/td> 4342K
代理商： MC56F8167E
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External Memory Interface Timing
56F8367 Technical Data, Rev. 3.0
Freescale Semiconductor
Preliminary
149
Table 10-16 External Memory Interface Timing
Characteristic
Symbol
Wait States
Configuration
D
M
Wait States
Controls
Unit
Address Valid to WR Asserted
t
AWR
WWS=0
WWS>0
WWS=0
WWS>0
WWS=0
WWS=0
WWS>0
WWS>0
-2.076
-1.795
-0.094
-0.012
-9.321
-1.160
-8.631
-0.879
0.50
WWSS
ns
0.75 + DCAOE
0.25 + DCAOE
0
0.25 + DCAEO
0.00
0.50
0.25 + DCAOE
WR Width Asserted to WR
Deasserted
t
WR
WWS
ns
Data Out Valid to WR Asserted
t
DWR
WWSS
ns
Valid Data Out Hold Time after WR
Deasserted
t
DOH
-2.086
0.25 + DCAEO
WWSH
ns
Valid Data Out Set-Up Time to WR
Deasserted
t
DOS
-0.563
-8.315
0.25 + DCAOE
0.50
WWS,WWSS
ns
Valid Address after WR Deasserted
t
WAC
-3.432
0.25 + DCAEO
WWSH
ns
RD Deasserted to Address Invalid
t
RDA
-1.780
0.00
RWSH
ns
Address Valid to RD Deasserted
t
ARDD
-2.120
1.00
RWSS,RWS
ns
Valid Input Data Hold after RD
Deasserted
t
DRD
0.00
N/A
1
1. N/A since device captures data before it deasserts RD
2. If RWSS = RWSH = 0, and the chip select does not change, then RD does not deassert during back-to-back reads.
3. Substitute BMDAR for MDAR if there is no chip select
4. MDAR is active in this calculation only when the chip select changes.
—
ns
RD Assertion Width
t
RD
0.279
1.00
RWS
ns
Address Valid to Input Data Valid
t
AD
-15.723
-20.642
1.00
RWSS,RWS
ns
1.25 + DCAOE
Address Valid to RD Asserted
t
ARDA
-2.603
0.00
RWSS
ns
RD Asserted to Input Data Valid
t
RDD
-13.120
-18.039
1.00
RWSS,RWS
ns
1.25 + DCAOE
WR Deasserted to RD Asserted
t
WRRD
-2.135
0.25 + DCAEO
WWSH,RWSS
ns
RD Deasserted to RD Asserted
t
RDRD
-0.483
2
0.00
RWSS,RWSH
MDAR
3,
4
ns
WR Deasserted to WR Asserted
t
WRWR
WWS=0
WWS>0
WWS=0
WWS>0
-1.608
-0.918
-0.096
0.084
0.75 + DCAEO
1.00
0.50
0.75 + DCAOE
WWSS, WWSH
ns
RD Deasserted to WR Asserted
t
RDWR
RWSH, WWSS,
MDAR
3
ns
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PDF描述
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