參數(shù)資料
型號(hào)： MC10EP139DW
廠商： ON SEMICONDUCTOR
元件分類： 時(shí)鐘及定時(shí)
英文描述： 3.3V / 5V ECL /2/4, /4/5/6 Clock Generation Chip
中文描述： 10E SERIES, LOW SKEW CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO20
封裝： PLASTIC, SOIC-20
文件頁數(shù)： 2/14頁
文件大小： 102K
代理商： MC10EP139DW
MC10EP139, MC100EP139
http://onsemi.com
2
C
Figure 1. 20Lead Pinout
(Top View)
C
M
V
C
17
18
16
15
14
13
12
4
3
5
6
7
8
9
D
Q0
11
10
Q1
Q1
Q2
Q2
Q3
Q3
V
EE
E
19
20
2
1
V
CC
Q0
V
B
V
C
Warning: All V
CC
and V
EE
pins must be externally connected to
Power Supply to guarantee proper operation.
D
D
Table 1. PIN DESCRIPTION
PIN
FUNCTION
CLK*, CLK*
ECL Differential Clock Inputs
EN*
ECL Sync Enable
MR*
ECL Master Reset
V
BB
ECL Reference Output
Q0, Q1, Q0, Q1
ECL Differential
2/4 Outputs
Q2, Q3, Q2, Q3
ECL Differential
4/5/6 Outputs
DIVSELa*
ECL Frequency Select Input
2/4
DIVSELb0*
ECL Frequency Select Input
4/5/6
DIVSELb1
ECL Frequency Select Input
4/5/6
V
CC
ECL Positive Supply
V
EE
ECL Negative Supply
*Pins will default low when left open.
CLK
CLK
EN
MR
DIVSELb1
÷
2/4
Q0
Q0
Q1
Q1
÷
4/5/6
Q2
Q2
Q3
Q3
Figure 2. Logic Diagram
R
R
DIVSELa
DIVSELb0
V
EE
Table 2. FUNCTION TABLES
CLK
EN
MR
Function
Z
ZZ
X
L
H
X
L
L
H
Divide
Hold Q0:3
Reset Q0:3
Z = LowtoHigh Transition
ZZ = HightoLow Transition
DIVSELa
Q0:1 Outputs
L
H
Divide by 2
Divide by 4
DIVSELb0
DIVSELb1
Q2:3 Outputs
L
H
L
H
L
L
H
H
Divide by 4
Divide by 6
Divide by 5
Divide by 5
相關(guān)PDF資料
PDF描述
MC100EP139DW 3.3V / 5V ECL /2/4, /4/5/6 Clock Generation Chip
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MC10EP139 3.3V / 5V ECL /2/4, /4/5/6 Clock Generation Chip
MC10EP139DT 3.3V / 5V ECL /2/4, /4/5/6 Clock Generation Chip
MC10EP16DR2 Differential Receiver
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參數(shù)描述
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