WARNING: The values given below are for an I/O driving strength IO
參數(shù)資料
型號(hào)： MB96F326RSBPMC-GSE2
廠商： Fujitsu Semiconductor America Inc
文件頁(yè)數(shù)： 93/108頁(yè)
文件大?。?/td> 0K
描述： IC MCU FLASHK/ROM MEMORY 80LQFP
標(biāo)準(zhǔn)包裝： 1
系列： F²MC MB96320
核心處理器： F²MC-16FX
芯體尺寸： 16-位
速度： 56MHz
連通性： CAN，EBI/EMI，I²C，LIN，SCI，UART/USART
外圍設(shè)備： DMA，LVD，LVR，POR，PWM，WDT
輸入/輸出數(shù)： 66
程序存儲(chǔ)器容量： 288KB（288K x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 12K x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 18x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 125°C
封裝/外殼： 80-LQFP
包裝： 托盤
產(chǎn)品目錄頁(yè)面： 722 (CN2011-ZH PDF)
其它名稱： 865-1082
MB96320 Series
FME-MB96320 rev 7
85
USART timing
WARNING: The values given below are for an I/O driving strength IOdrive = 5mA. If IOdrive is 2mA, all the maximum
output timing described in the different tables must then be increased by 10ns.
Notes:
AC characteristic in CLK synchronized mode.
CL is the load capacity value of pins when testing.
Depending on the used machine clock frequency, the maximum possible baud rate can be limited by some
parameters. These parameters are shown in “MB96300 Super series HARDWARE MANUAL”
tCLKP1 is the cycle time of the peripheral clock 1 (CLKP1), Unit : ns
*1: Parameter N depends on tSCYCI and can be calculated as follows:
if tSCYCI = 2*k*tCLKP1, then N = k, where k is an integer > 2
if tSCYCI = (2*k+1)*tCLKP1, then N = k+1, where k is an integer > 1
Examples:
(TA = -40C to 125C, VCC = 3.0V to 5.5V, VSS = AVSS = 0V, IOdrive = 5mA, CL = 50pF)
Parameter
Symbol
Pin
Condition
VCC =AVCC= 4.5V
to 5.5V
VCC =AVCC= 3.0V
to 4.5V
Unit
Min
Max
Min
Max
Serial clock cycle time
tSCYCI
SCKn
Internal Shift
Clock Mode
4 tCLKP1
4 tCLKP1
ns
SCK
↓→ SOT delay
time
tSLOVI
SCKn,
SOTn
-20
+20
-30
+30
ns
SOT
→ SCK ↑ delay
time
tOVSHI
SCKn,
SOTn
N*tCLKP1
- 20 *1
N*tCLKP1 -
30 *1
ns
Valid SIN
→ SCK ↑
tIVSHI
SCKn,
SINn
tCLKP1 +
45
tCLKP1 +
55
ns
SCK
↑→ Valid SIN
hold time
tSHIXI
SCKn,
SINn
0
0
ns
Serial clock “L” pulse
width
tSLSHE
SCKn
External Shift
Clock Mode
tCLKP1 +
10
tCLKP1 +
10
ns
Serial clock “H” pulse
width
tSHSLE
SCKn
tCLKP1 +
10
tCLKP1 +
10
ns
SCK
↓→ SOT delay
time
tSLOVE
SCKn,
SOTn
2 tCLKP1
+ 45
2 tCLKP1
+ 55
ns
Valid SIN
→ SCK ↑
tIVSHE
SCKn,
SINn
tCLKP1/2
+ 10
tCLKP1/2 +
10
ns
SCK
↑→ Valid SIN
hold time
tSHIXE
SCKn,
SINn
tCLKP1 +
10
tCLKP1 +
10
ns
SCK fall time
tFE
SCKn
20
20
ns
SCK rise time
tRE
SCKn
20
20
ns
tSCYCI
N
4*tCLKP1
2
5*tCLKP1, 6*tCLKP1
3
7*tCLKP1, 8*tCLKP1
4
...
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PDF描述
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MB96F326YWAPMC-GE2 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:16-bit Proprietary Microcontroller
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