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參數資料
| 型號： | MB89P475PFV-201 |
| 廠商： | FUJITSU LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, OTPROM, 12.5 MHz, MICROCONTROLLER, PQFP48 |
| 封裝： | 7 X 7 MM, 1.70 MM HEIGHT, 0.50 MM PITCH, PLASTIC, LQFP-48 |
| 文件頁數： | 267/396頁 |
| 文件大?。?/td> | 11601K |
| 代理商： | MB89P475PFV-201 |
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CHAPTER 14 UART/SIO
I Receiving operation in asynchronous mode
Bits CLK2 to CLK0 of the SMC11/21 register select the baud rate clock. For information on the baud rate
Table 14.1-1 "Baud rate setting". Receiving is enabled when the RXE bit of the SMC11/21 register is set
to "1". Receiving operation starts at the first falling edge (detection of a start bit) of input data. Once
receiving operation has ended, the RDRF bit of the SSD1/2 register is set to "1", and receiving data is
loaded into the SIDR1/2 register. Also, if the RDRF bit is set to "1" when the RIE bit is "1", a receiving
interrupt is sent to the CPU. If any one of three errors (PER, OVE, or FER) is present when receiving ends,
the RDRF bit will not be set to "1", and receiving data will not be loaded into SIDR1/2. Therefore, the
value in the SIDR1/2 register will be the former data received. Also, as long as the RXE bit is not set to
"0", receiving operation will continue when a start bit is detected even if an error flag is present.
Writing a "0" to the RXE bit of the SMC12/22 register during receiving operation will disable any further
receiving operation once current data receiving has ended.
Figure 14.7-4 Receiving operation in asynchronous mode.
I Receiving errors in asynchronous mode
Three types of error detection are performed in asynchronous mode. The three errors are: parity error,
overrun error, and framing error. When an error is detected, a "1" is set in the corresponding PER, OVE, or
FER bit of the SSD1/2 register.
These errors are detected as described below when receiving ends. When any of these errors is detected,
the RDRF bit will not be set, and receiving data will not be loaded into the SIDR1/2 register. Therefore the
value in the SIDR1/2 register will be last data received. Also, these error flags can all be cleared by writing
"0" into the RERC bit of the SMC12/22 register.
Figure 14.7-5 Set timing for receive errors
D0 D1 D2 D3 D4 D5 D6
St
Sp Sp
D7
D0 D1 D2
St
RXE
SI1/2
SIDR1/2 is read
RDRF
D5
Error interrupt
D6
D7/P
Sp
SI1/2
PER
OVE
FER
相關PDF資料 |
PDF描述 |
|---|---|
| MB89P475PFM-101 | 8-BIT, OTPROM, 12.5 MHz, MICROCONTROLLER, PQFP48 |
| MB89P475PFV-101 | 8-BIT, 12.5 MHz, MICROCONTROLLER, PQFP48 |
| MB89475P-SH | 8-BIT, 12.5 MHz, MICROCONTROLLER, PDIP48 |
| MB89P475PFV-202 | 8-BIT, 12.5 MHz, MICROCONTROLLER, PQFP48 |
| MB89P475P-SH-202 | 8-BIT, 12.5 MHz, MICROCONTROLLER, PDIP48 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| MB89P485 | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:8-bit Proprietary Microcontroller |
| MB89P485-101PFM | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:8-bit Proprietary Microcontroller |
| MB89P485-101P-SH | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:8-bit Proprietary Microcontroller |
| MB89P485-102PFM | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:8-bit Proprietary Microcontroller |
| MB89P485-102P-SH | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:8-bit Proprietary Microcontroller |
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