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參數(shù)資料
| 型號： | MAX9208EAI+T |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 9/12頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DESERIALIZER LVDS 28-SSOP |
| 其它有關(guān)文件： | Automotive Product Guide |
| 產(chǎn)品培訓模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標準包裝： | 2,000 |
| 功能： | 解串器 |
| 數(shù)據(jù)速率： | 660Mbps |
| 輸入類型： | LVDS |
| 輸出類型： | LVTTL，LVCMOS |
| 輸入數(shù)： | 1 |
| 輸出數(shù)： | 10 |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 28-SSOP（0.209"，5.30mm 寬） |
| 供應商設(shè)備封裝： | 28-SSOP |
| 包裝： | 帶卷 (TR) |
MAX9206/MAX9208
10-Bit Bus LVDS Deserializers
Figure 5. Data Valid Times
tROS
tROH
RCLK
RCLK_R/F = LOW
RCLK
RCLK_R/F = HIGH
DATA VALID
BEFORE RCLK
DATA VALID
AFTER RCLK
ROUT_
50%
Figure 6. High-Impedance Test Circuit and Timing
CL
+7V FOR tLZR AND tZLR
OPEN FOR tHZR AND tZHR
450
Ω
500
Ω
SCOPE
50
Ω
REN
ROUT_
RCLK
VOL
VOH
tLZR
tHZR
tZLR
1.5V
tZHR
VOL +0.5V
VOH -0.5V
Figure 2. Input Fail-Safe Circuit
VCC
VCC - 0.3V
TO DESERIALIZING
CIRCUITRY
RI+
RI-
RIN1
RIN2
Figure 3. LVCMOS/LVTTL Output Load and Transition Times
80%
20%
tCLH
tCHL
CL
15pF
LVCMOS/LVTTL
OUTPUT
Figure 4. Input-to-Output Delay
START
BIT
START
BIT
END
BIT
START
BIT
END
BIT
SYMBOL N
SYMBOL N+1
SYMBOL N-1
SYMBOL N
tDD
RI
RCLK
ROUT_
RCLK_R/F = HIGH
0123456789
012
Test Circuits/Timing Diagrams (continued)
6
_______________________________________________________________________________________
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