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參數(shù)資料
| 型號： | MAX3634ETM+T |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 3/8頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLOCK PHASE ALIGNER 48-TQFN |
| 產(chǎn)品培訓模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標準包裝： | 2,500 |
| 類型： | 時鐘相位定位器 |
| PLL： | 無 |
| 主要目的： | GPON 光纖線路終端（OLT）接收器 |
| 輸入： | LVPECL |
| 輸出： | LVPECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:1 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 155.52MHz |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 48-WFQFN 裸露焊盤 |
| 供應商設備封裝： | 48-TQFN-EP（7x7） |
| 包裝： | 帶卷 (TR) |
MAX3634
622Mbps/1244Mbps Burst-Mode Clock
Phase Aligner for GPON OLT Applications
_______________________________________________________________________________________
3
ELECTRICAL CHARACTERISTICS (continued)
(VCC = +3.0V to +3.6V, TA = -40
°C to +85°C. Typical values are at VCC = +3.3V, TA = +25°C, unless otherwise noted.)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
622Mbps (Notes 1, 2)
500
Serial Data Output Clock-to-Q
Delay (Figure 1)
tCLK-Q
1244Mbps (Notes 1, 2)
250
ps
622Mbps (Notes 1, 2)
500
Serial Data Output Q-to-Clock
Delay (Figure 1)
tQ-CLK
1244Mbps (Notes 1, 2)
250
ps
RATESEL Input High
VIH
2V
RATESEL Input Low
VIL
0.8
V
RATESEL Input Current
VIN = 0V or VCC
-100
+100
A
Note 1: PECL output must have external termination of 50
to VCC - 2V (Thevenin equivalent).
Note 2: AC parameters are guaranteed by design and characterization.
Note 3: From start of PON burst, 101010101010 preamble sequence.
Note 4: BER, acquisition time requirements are met with 100mVP-P sinusoidal noise on VCC, 0 < fNOISE
≤ 10MHz.
Note 5: Measured with 20psRMS input random jitter (1.244Mbps), 30psRMS (622Mbps)
Note 6: Jitter tolerance refers to the variation in phase between REFCLK and SDI after acquisition.
Typical Operating Characteristics
(VCC = +3.3V and TA = +25
°C, unless otherwise noted)
1.244Gbps
INPUT AND OUTPUT EYE DIAGRAMS
MAX3634
toc01
200ps/div
SDI
SDO
622Mbps
INPUT AND OUTPUT EYE DIAGRAMS
MAX3634
toc02
400ps/div
SDI
SDO
BURST CAPTURE AT 1.244Gbps
MAX3634
toc03
1ns/div
RST
SDI
SDO
LOCK
(SCLK+) - (SCLK-)
(SDO+) - (SDO-)
tCLK-Q
tQ-CLK
Figure 1. Definition of Clock-to-Q and Q-to-Clock Delay
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| MAX3635ECB+ | 功能描述:計時器和支持產(chǎn)品 New RoHS:否 制造商:Micrel 類型:Standard 封裝 / 箱體:SOT-23 內(nèi)部定時器數(shù)量:1 電源電壓-最大:18 V 電源電壓-最小:2.7 V 最大功率耗散: 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝:Reel |
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| MAX3636ETM+T | 功能描述:時鐘發(fā)生器及支持產(chǎn)品 Not Available From Mouser RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:QFN-56 |
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