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參數(shù)資料
| 型號： | M470L3223DT0-CB0 |
| 廠商： | SAMSUNG SEMICONDUCTOR CO. LTD. |
| 英文描述： | 256MB DDR SDRAM MODULE |
| 中文描述： | 256MB的DDR內(nèi)存模塊 |
| 文件頁數(shù)： | 4/16頁 |
| 文件大?。?/td> | 171K |
| 代理商： | M470L3223DT0-CB0 |
M470L3223DT0
Rev. 0.0 Dec. 2001
S0
I/0 0
I/0 1
I/0 2
I/0 3
I/0 4
I/0 5
I/0 6
I/0 7
D0
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
DQS
DM
S
FUNCTIONAL BLOCK DIAGRAM
A0 - A13
A0-A13: DDR SDRAMs D0 - D7
BA0 - BA1
BA0-BA1: DDR SDRAMs D0 - D7
RAS
RAS: SDRAMs D0 - D7
CAS
CAS: SDRAMs D0 - D7
CKE0
CKE: SDRAMs D0 - D7
WE
WE: SDRAMs D0 - D7
Notes:
1. DQ-to-I/O wiring is shown as recom-
mended but may be changed.
2. DQ/DQS/DM/CKE/CS relationships must
be maintained as shown.
3. DQ, DQS, DM/DQS resistors: 22 Ohms.
4. VDDID strap connections
(for memory device VDD, VDDQ):
STRAP OUT (OPEN): VDD = VDDQ
STRAP IN (VSS): VDD
≠
VDDQ.
A0
Serial PD
A1
A2
SA0
SA1
SA2
SCL
WP
SDA
V
SS
D0 - D7
D0 - D7
V
DD
/V
DDQ
D0 - D7
D0 - D7
VREF
V
DDID
Strap: see Note 4
V
DDSPD
SPD
Clock Wiring
Clock
Input
CK0/CK0
CK1/CK1
CK2/CK2
SDRAMs
4 SDRAMs
4 SDRAMs
NC
DQS0
DM0
*Clock Net Wiring
Card
Edge
Dram1
Dram2
±
5%
CK
CK
Dram3
Dram4
I/0 0
I/0 1
I/0 2
I/0 3
I/0 4
I/0 5
I/0 6
I/0 7
D4
DQS
DM
S
DQS4
DM4
I/0 0
I/0 1
I/0 2
I/0 3
I/0 4
I/0 5
I/0 6
I/0 7
D1
DQ8
DQ9
DQ10
DQ11
DQ12
DQ13
DQ14
DQ15
DQS
DM
S
DQS1
DM1
I/0 0
I/0 1
I/0 2
I/0 3
I/0 4
I/0 5
I/0 6
I/0 7
D5
DQS
DM
S
DQS5
DM5
I/0 0
I/0 1
I/0 2
I/0 3
I/0 4
I/0 5
I/0 6
I/0 7
D2
DQ16
DQ17
DQ18
DQ19
DQ20
DQ21
DQ22
DQ23
DQS
DM
S
DQS2
DM2
I/0 0
I/0 1
I/0 2
I/0 3
I/0 4
I/0 5
I/0 6
I/0 7
D6
DQS
DM
S
DQS6
DM6
I/0 0
I/0 1
I/0 2
I/0 3
I/0 4
I/0 5
I/0 6
I/0 7
D3
DQ24
DQ25
DQ26
DQ27
DQ28
DQ29
DQ30
DQ31
DQS
DM
S
DQS3
DM3
I/0 0
I/0 1
I/0 2
I/0 3
I/0 4
I/0 5
I/0 6
I/0 7
D7
DQS
DM
S
DQS7
DM7
DQ32
DQ33
DQ34
DQ35
DQ36
DQ37
DQ38
DQ39
DQ40
DQ41
DQ42
DQ43
DQ44
DQ45
DQ46
DQ47
DQ48
DQ49
DQ50
DQ51
DQ52
DQ53
DQ54
DQ55
DQ56
DQ57
DQ58
DQ59
DQ60
DQ61
DQ62
DQ63
相關(guān)PDF資料 |
PDF描述 |
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| M470L3223DT0-CB3 | 256MB DDR SDRAM MODULE |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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