參數(shù)資料
型號： M38235G2-XXXFP
廠商： Renesas Technology Corp.
英文描述： 72-Mbit (2M x 36/4M x 18/1M x 72) Pipelined SRAM with NoBL(TM) Architecture; Architecture: NoBL, Pipeline; Density: 72 Mb; Organization: 2Mb x 36; Vcc (V): 3.1 to 3.6 V
中文描述： 單芯片8位CMOS微機
文件頁數(shù)： 55/76頁
文件大小： 896K
代理商： M38235G2-XXXFP
Rev.2.02 Jun 19, 2007 page 55 of 73
REJ03B0146-0202
3823 Group
QzROM Writing Mode
In the QzROM writing mode, the user ROM area can be rewritten
while the microcomputer is mounted on-board by using a serial
programmer which is applicable for this microcomputer.
Table 13 lists the pin description (QzROM writing mode) and Fig-
ure 58 and Figure 59 show the pin connections.
Refer to Figure 60 and Figure 61 for examples of a connection
with a serial programmer.
Contact the manufacturer of your serial programmer for serial pro-
grammer. Refer to the user’s manual of your serial programmer
for details on how to use it.
Table 13 Pin description (QzROM writing mode)
Apply 1.8 to 5.5 V to V
CC
, and 0 V to V
SS
.
Reset input pin for active “L”. Reset occurs when RESET pin is hold at an “L” level
for 16 cycles or more of X
IN
.
Set the same termination as the single-chip mode.
Input the reference voltage of A/D converter to V
REF
.
Connect AVss to Vss.
Input “H” or “L” level signal or leave the pin open.
QzROM programmable power source pin.
Serial data I/O pin.
Serial clock input pin.
Read/program pulse input pin.
V
CC
, V
SS
RESET
X
IN
X
OUT
V
REF
AV
SS
P0
0
–P0
7
P1
0
–P1
7
P2
0
–P2
7
P3
4
–P3
7
P4
1
–P4
4
P5
0
–P5
7
P6
0
–P6
7
P4
0
P4
4
P4
2
P4
3
Power source
Reset input
Clock input
Clock output
Analog reference voltage
Analog power source
I/O port
V
PP
input
ESDA input/output
ESCLK input
ESPGMB input
Function
Pin
Name
Input
Input
Input
Output
Input
Input
I/O
Input
I/O
Input
Input
I/O
相關PDF資料
PDF描述
M38235G2-XXXHP 72-Mbit (2M x 36/4M x 18/1M x 72) Pipelined SRAM with NoBL(TM) Architecture; Architecture: NoBL, Pipeline; Density: 72 Mb; Organization: 2Mb x 36; Vcc (V): 3.1 to 3.6 V
M38235G3-XXXFP 72-Mbit (2M x 36/4M x 18/1M x 72) Pipelined SRAM with NoBL(TM) Architecture; Architecture: NoBL, Pipeline; Density: 72 Mb; Organization: 2Mb x 36; Vcc (V): 3.1 to 3.6 V
M38235G3-XXXHP 72-Mbit (2M x 36/4M x 18/1M x 72) Pipelined SRAM with NoBL(TM) Architecture; Architecture: NoBL, Pipeline; Density: 72 Mb; Organization: 2Mb x 36; Vcc (V): 3.1 to 3.6 V
M38235G4-XXXFP 72-Mbit (2M x 36/4M x 18/1M x 72) Pipelined SRAM with NoBL(TM) Architecture; Architecture: NoBL, Pipeline; Density: 72 Mb; Organization: 2Mb x 36; Vcc (V): 3.1 to 3.6 V
M38235G4-XXXHP SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER
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參數(shù)描述
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