參數(shù)資料
型號: M34507E4FP
元件分類: 微控制器/微處理器
英文描述: 4-BIT, OTPROM, MICROCONTROLLER, PDSO24
封裝: 5.30 X 10.10 MM, 0.80 MM PITCH, PLASTIC, SSOP-24
文件頁數(shù): 37/216頁
文件大?。?/td> 3262K
代理商: M34507E4FP
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2.2 Interrupts
2-16
Rev.2.01
Feb 04, 2005
4507 Group
APPLICATION
REJ09B0195-0201
Interrupt control register I1
at reset : 00002
at RAM back-up : state retained
R/W
INT pin input disabled
INT pin input enabled
Falling waveform (“L” level of INT pin is recognized with
the SNZI0 instruction)/“L” level
Rising waveform (“H” level of INT pin is recognized with
the SNZI0 instruction)/“H” level
One-sided edge detected
Both edges detected
Disabled
Enabled
INT pin input control bit (Note 2)
Interrupt valid waveform for INT
pin/return level selection bit
(Note 2)
INT pin edge detection circuit
control bit
INT pin
timer 1 control enable bit
0
1
0
1
0
1
0
1
I13
I12
I11
I10
Notes 1: “R” represents read enabled, and “W” represents write enabled.
2: When the contents of I12 and I13 are changed, the external interrupt request flag EXF0 may be
set. Accordingly, clear EXF0 flag with the SNZ0 instruction when the bit 0 (V10) of register V1 to
“0”. In this time, set the NOP instruction after the SNZ0 instruction, for the case when a skip is
performed with the SNZ0 instruction.
(5)
Interrupt control register I1
The INT pin timer 1 control enable bit is assigned to bit 0, INT pin edge detection circuit control bit
is assigned to bit 1, interrupt valid waveform for INT pin/return level selection bit is assigned to bit
2 and INT pin input control bit is assigned to bit 3.
Set the contents of this register through register A with the TI1A instruction.
In addition, the TAI1 instruction can be used to transfer the contents of register I1 to register A.
Table 2.2.3 shows the interrupt control register I1.
Table 2.2.3 Interrupt control register I1
相關(guān)PDF資料
PDF描述
M34507M2-XXXFP 4-BIT, MROM, MICROCONTROLLER, PDSO24
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