參數(shù)資料
型號： M30622F8PFP-D9
元件分類： 微控制器/微處理器
英文描述： 16-BIT, FLASH, 24 MHz, MICROCONTROLLER, PQFP100
封裝： 14 X 20 MM, 0.65 MM PITCH, PLASTIC, QFP-100
文件頁數(shù)： 65/87頁
文件大小： 919K
代理商： M30622F8PFP-D9
VCC1 = VCC2 = 3V
M16C/62P Group (M16C/62P, M16C/62PT)
5. Electrical Characteristics (M16C/62P)
4
8
f
o
4
0
2
,
1
0
p
e
S
0
3
.
2
.
v
e
R
Z
0
3
2
0
-
1
0
B
3
0
J
E
R
page 68
Figure 5.20 Timing Diagram (8)
Memory Expansion Mode, Microprocessor Mode
(For 2-wait setting, external area access and multiplex bus selection)
BCLK
CSi
td(BCLK-CS)
40ns.max
ADi
td(BCLK-AD)
40ns.max
ALE
th(BCLK-ALE)
-4ns.min
RD
40ns.max
th(BCLK-RD)
0ns.min
th(BCLK-AD)
4ns.min
th(BCLK-CS)
4ns.min
tcyc
th(RD-CS)
th(RD-AD)
BHE
ADi
/DBi
th(RD-DB)
0ns.min
td(AD-ALE)
Read timing
td(BCLK-WR)
40ns.max
th(BCLK-WR)
0ns.min
BCLK
CSi
td(BCLK-CS)
40ns.max
ADi
td(BCLK-AD)
40ns.max
ALE
40ns.max
th(BCLK-ALE)
-4ns.min
th(BCLK-AD)
4ns.min
th(BCLK-CS)
4ns.min
tcyc
th(WR-AD)
BHE
td(BCLK-DB)
50ns.max
4ns.min
th(BCLK-DB)
td(DB-WR)
th(WR-DB)
ADi
/DBi
Data output
WR,WRL,
WRH
Write timing
Address
(0.5 X tcyc-10)ns.min
Address
Data input
50ns.min
(0.5 X tcyc-10)ns.min
td(BCLK-ALE)
td(BCLK-RD)
(0.5 X tcyc-10)ns.min
th(WR-CS)
Address
td(AD-ALE)
(0.5 X tcyc-40)ns.min
(1.5 X tcyc-50)ns.min
(0.5 X tcyc-10)ns.min
td(BCLK-ALE)
(0.5 X tcyc-40)ns.min
Address
40ns.max
tSU(DB-RD)
tac3(RD-DB)
(0.5 X tcyc-10)ns.min
th(ALE-AD)
td(AD-RD)
0ns.min
tdZ(RD-AD)
8ns.max
td(AD-WR)
0ns.min
Measuring conditions
VCC1=VCC2=3V
Input timing voltage
: VIL=0.6V, VIH=2.4V
Output timing voltage : VOL=1.5V, VOH=1.5V
(1.5 X tcyc-60)ns.max
tcyc=
1
f(BCLK)
(0.5 X tcyc-15)ns.min
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PDF描述
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