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參數(shù)資料
| 型號： | M30281M4V-XXXHP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, MROM, 20 MHz, MICROCONTROLLER, PQFP64 |
| 封裝： | 12 X 12 MM, 0.50 MM PITCH, PLASTIC, LQFP-80 |
| 文件頁數(shù)： | 391/415頁 |
| 文件大?。?/td> | 2591K |
| 代理商： | M30281M4V-XXXHP |
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M16C/28 Group
Under development Preliminary specification
Specifications in this manual are tentative and subject to change.
9. Interrupts
Rev.0.60 2004.02.01
page 59 of N
REJ09B0047-0060Z
9.3 Interrupt Control
The following describes how to enable/disable the maskable interrupts, and how to set the priority in
which order they are accepted. What is explained here does not apply to nonmaskable interrupts.
Use the FLG register’s I flag, IPL, and each interrupt control register’s ILVL2 to ILVL0 bits to enable/
disable the maskable interrupts. Whether an interrupt is requested is indicated by the IR bit in each
interrupt control register.
Figure 9.3.1 shows the interrupt control registers.
Also, the following interrupts share a vector and an interrupt control register.
________
INT4 and SIO3
________
INT5 and SIO4
ICOC base timer and SCL/SDA
ICOC interrupt 1 and I2C-BUS interface
An interrupt request is set by the IFSR6, IFSR7 bits in the IFSR register and the IFSR26 and IFSR27 bits
in the IFSR2A register. Figure 9.3.2 shows the IFSR, IFSR2A registers.
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