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參數(shù)資料
| 型號： | LP62S2048AU-70LLT |
| 廠商： | AMIC Technology Corporation |
| 英文描述： | 256K X 8 BIT LOW VOLTAGE CMOS SRAM |
| 中文描述： | 256K × 8位低電壓CMOS的SRAM |
| 文件頁數(shù)： | 17/17頁 |
| 文件大小： | 190K |
| 代理商： | LP62S2048AU-70LLT |
LP62S2048A-I Series
PRELIMINARY
(June, 2002, Version 0.0)
9
AMIC Technology, Inc.
Timing Waveforms (continued)
Read Cycle 4
(1)
tRC
Address
CE2
DOUT
tAA
tOE
tOLZ5
tACE1
tCLZ15
tACE2
tCLZ25
tCHZ25
tOHZ5
tCHZ15
tOH
OE
CE1
Notes: 1. WE is high for Read Cycle.
2. Device is continuously enabled CE1 = VIL and CE2 = VIH.
3. Address valid prior to or coincident with CE1 transition low.
4. OE = VIL.
5. Transition is measured
±500mV from steady state. This parameter is sampled and not 100% tested.
6. CE2 is high.
7. CE1 is low.
8. Address valid prior to or coincident with CE2 transition high.
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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