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參數(shù)資料
| 型號： | LP3907SQ-JIXI |
| 廠商： | NATIONAL SEMICONDUCTOR CORP |
| 元件分類： | 穩(wěn)壓器 |
| 英文描述： | 1.5 A DUAL SWITCHING CONTROLLER, 2100 kHz SWITCHING FREQ-MAX, QCC24 |
| 封裝： | 4 X 4 MM, 0.8 MM HEIGHT, LLP-24 |
| 文件頁數(shù)： | 17/44頁 |
| 文件大?。?/td> | 3058K |
| 代理商： | LP3907SQ-JIXI |
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Faults Occurring in Counter Delay After Startup
30017881
The above timing diagram details the Power good with delay
with respect to the enable signals EN1, and EN2. The RDY1,
RDY2 are internal signals derived from the output of two com-
parators. Each comparator has been trimmed as follows:
Comparator Level
Buck Supply Level
HIGH
Greater than 94%
LOW
Less than 85%
The circuits for EN1 and RDY1 is symmetrical to EN2 and
RDY2, so each reference to EN1 and RDY1 will also work for
EN2 and RDY2 and vice versa.
If EN1 and RDY1 signals are High at time t1, then the RDY1
signal rising edge triggers the programmable delay counter
(50
μs, 50ms, 100ms, 200ms). This delay forces nPOR LOW
between time interval t1 and t2. nPOR is then pulled high after
the programmable delay is completed. Now if EN2 and RDY2
are initiated during this interval the nPOR signal ignores this
event.
If either RDY1or RDY2 were to go LOW at t3 then the pro-
grammable delay is triggered again.
www.national.com
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LP3907
相關PDF資料 |
PDF描述 |
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| LP3923TL-VB | 1-CHANNEL POWER SUPPLY SUPPORT CKT, PBGA30 |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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| LP3907SQ-JXQX/S7001874 | 制造商:Texas Instruments 功能描述:NSCLP3907SQ-JXQX@S7001874 1A&0.6A BUCKS |
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