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參數(shù)資料
| 型號： | LMX2364TM |
| 廠商： | NATIONAL SEMICONDUCTOR CORP |
| 元件分類： | XO, clock |
| 英文描述： | 2.6 GHz PLLatinum Fractional RF Frequency Synthesizer with 850 MHz Integer IF Frequency Synthesizer |
| 中文描述： | PLL FREQUENCY SYNTHESIZER, 2600 MHz, PDSO24 |
| 封裝： | TSSOP-24 |
| 文件頁數(shù)： | 34/39頁 |
| 文件大?。?/td> | 694K |
| 代理商： | LMX2364TM |
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Supplemental Information
3.0 USE OF THE DIGITAL LOCK DETECT FUNCTION
The Lock Detect Digital Filter compares the difference be-
tween the phase of the inputs of the phase detector to a RC
generated delay of approximately 15nS. To enter the locked
state (Lock = HIGH) the phase error must be less than the
15nS RC delay for 5 consecutive reference cycles. Once in
lock (Lock = HIGH), the RC delay is changed to approxi-
mately 30nS. To exit the locked state (Lock = LOW), the
phase error must become greater than the 30nS RC delay.
When the PLL is in the power down mode, Lock is forced
LOW. A flow chart of the digital filter is shown below.
20050604
L
www.national.com
34
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PDF描述 |
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