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參數資料
| 型號： | LFXP3C-5T100C |
| 廠商： | Lattice Semiconductor Corporation |
| 文件頁數： | 241/397頁 |
| 文件大小： | 0K |
| 描述： | IC FPGA 3.1KLUTS 62I/O 100-TQFP |
| 標準包裝： | 90 |
| 系列： | XP |
| 邏輯元件/單元數： | 3000 |
| RAM 位總計： | 55296 |
| 輸入/輸出數： | 62 |
| 電源電壓： | 1.71 V ~ 3.465 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 100-LQFP |
| 供應商設備封裝： | 100-TQFP（14x14） |
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13-16
Lattice Semiconductor
LatticeXP sysCONFIG Usage Guide
Figure 13-7. Wake Up Sequence to Internal Clock
Synchronous to Internal Done Bit
If the LatticeXP device is the only device in the chain, or the last device in a chain, the wake up process should be
initiated by the completion of the configuration. Once the configuration is complete, the internal Done bit will be set
and then the wake up process will begin.
Synchronous to External DONE Signal
The DONE pin can be selected to delay wake up. If DONE_EX is true then the wake up sequence will be delayed
until the DONE pin is high. The device will then follow the WAKE_UP sequence selected.
Software Selectable Options
In order to control the configuration of the LatticeXP device beyond the default settings, software preferences are
used. Table 13-9 is a list of the preferences with their default settings.
21 (Default)
GOE
GWDIS, GSR
DONE
22
GOE, GWDIS
GSR
DONE
23
GWDIS
GOE, GSR
DONE
24
GWDIS, GSR
GOE
DONE
25
GOE, GSR
GWDIS
DONE
Table 13-8. Wake Up Sequences Supported by LatticeXP (Continued)
Sequence
Phase T0
Phase T1
Phase T2
Phase T3
CLK
DONE BIT
GLOBAL OUTPUT ENABLE
GLOBAL SET/RESET
GLOBAL WRITE DISABLE
DONE PIN
T0
T1
T2
T3
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