參數(shù)資料
型號(hào)： LFXP20C-4F256I
廠商： Lattice Semiconductor Corporation
文件頁(yè)數(shù)： 113/397頁(yè)
文件大小： 0K
描述： IC FPGA 19.7KLUTS 188I/O 256-BGA
標(biāo)準(zhǔn)包裝： 90
系列： XP
邏輯元件/單元數(shù)： 20000
RAM 位總計(jì)： 405504
輸入/輸出數(shù)： 188
電源電壓： 1.71 V ~ 3.465 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 256-BGA
供應(yīng)商設(shè)備封裝： 256-FPBGA（17x17）
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2-8
Architecture
Lattice Semiconductor
LatticeXP Family Data Sheet
Figure 2-6. Secondary Clock Sources
Clock Routing
The clock routing structure in LatticeXP devices consists of four Primary Clock lines and a Secondary Clock net-
work per quadrant. The primary clocks are generated from MUXs located in each quadrant. Figure 2-7 shows this
clock routing. The four secondary clocks are generated from MUXs located in each quadrant as shown in Figure 2-
8. Each slice derives its clock from the primary clock lines, secondary clock lines and routing as shown in Figure 2-
Figure 2-7. Per Quadrant Primary Clock Selection
20 Secondary Clock Sources
To Quadrant Clock Selection
From Routing
Clock Input
From Routing
From
Routing
From
Routing
From
Routing
Clock
Input
Clock
Input
From
Routing
From
Routing
From
Routing
From
Routing
From
Routing
4 Primary Clocks (CLK0, CLK1, CLK2, CLK3) per Quadrant
20 Primary Clock Sources: 12 PLLs + 4 PIOs + 4 Routing1
DCS2
1. Smaller devices have fewer PLL related lines.
2. Dynamic clock select.
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參數(shù)描述
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